[发明专利]一种数字信号固定插值倍数的线性插值方法和装置在审
| 申请号： | 201710026195.0 | 申请日： | 2017-01-13 |
| 公开（公告）号： | CN106897020A | 公开（公告）日： | 2017-06-27 |
| 发明（设计）人： | 宋民;李振军;王永添 | 申请（专利权）人： | 深圳市鼎阳科技有限公司 |
| 主分类号： | G06F3/05 | 分类号： | G06F3/05;G06T11/20;G01R13/02 |
| 代理公司： | 深圳鼎合诚知识产权代理有限公司44281 | 代理人： | 郭燕,彭家恩 |
| 地址： | 518000 广东省深圳市*** | 国省代码： | 广东;44 |
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| 摘要： | 本申请公开了一种固定插值倍数的线性插值装置，包括依次连接的第一加法器、移位寄存器、存储器、第二加法器、第三加法器以及与移位寄存器和存储器相连接的控制器，控制器控制移位寄存器进行移位运算和从存储器中读取多个移位数据；使用移位寄存器、存储器和第二加法器进行一系列的移位运算和加法运算实现乘法算法，避免使用乘法器，减少耗费的FPGA资源和运算量，加快运算速度，提高线性插值计算的实时性；还可以快速地进行并行运行，并行获得各个线性插值，运算速度快实时性好。相应地，本申请公开了一种固定插值倍数的线性插值方法。 | ||
| 搜索关键词： | 一种 数字信号 固定 倍数 线性插值 方法 装置 | ||
【主权项】：
一种数字信号固定插值倍数的线性插值方法，包括：先对待处理数字信号的初始数据y0、y*进行加法运算，得到Δy＝y*‑y0，然后根据拟插值的固定插值倍数生成待处理数字信号插值倍数数据ci，并求出ci与Δy之积ci.Δy，再对ci.Δy与y0进行加法运算，得到所需要的内插值yi＝ci·Δy+y0；其特征在于，所述求出待处理数字信号插值倍数数据ci与Δy之积ci·Δy包括：先对Δy进行移位运算生成至少一个移位数据，再对所述至少一个移位数据进行加法运算，得出ci与Δy之积ci.Δy。
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