[发明专利]一种三冗余1553B总线动态切换方法有效
申请号: | 201710245410.6 | 申请日: | 2017-04-14 |
公开(公告)号: | CN107347018B | 公开(公告)日: | 2019-12-20 |
发明(设计)人: | 程亮;周如好;余薛浩;梁家诚;杨孔进;杜建峰;陈川 | 申请(专利权)人: | 上海航天控制技术研究所 |
主分类号: | H04L12/24 | 分类号: | H04L12/24;H04L12/26;H04L12/40 |
代理公司: | 11009 中国航天科技专利中心 | 代理人: | 范晓毅 |
地址: | 201109 *** | 国省代码: | 上海;31 |
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摘要: | 本发明提供了一种三冗余1553B总线动态切换方法,所述方法包括如下步骤:步骤一:建立三机冗余总线网络计算机系统架构;步骤二:设计冗余总线的配置方法,默认总线A通信作为主总线,计算机系统上电状态默认第一冗余模块为当班机,第一总线芯片配置为BC模式,第二总线芯片和第三总线芯片均配置为MT模式;步骤三:设计总线故障诊断方法,实现三机总线实时故障识别;步骤四:按照当班机切换原则重新组建一个BC模式和两个MT模式的三冗余总线模式。本发明使实时性与高可靠性需求的航天器计算机利用总线的串行时序特性与信息监视功能就可以确定三冗余的总线故障,实现简单,运行可靠,不受外界环境的影响,具有快速性、便于工程应用。 | ||
搜索关键词: | 一种 冗余 1553 总线 动态 切换 方法 | ||
【主权项】:
1.一种三冗余1553B总线动态切换方法,其特征在于,所述方法包括如下步骤:/n步骤一:建立三机冗余总线网络计算机系统架构;其中,三机冗余总线网络计算机系统架构包括第一冗余模块(10)、第二冗余模块(11)和第三冗余模块(12);第一冗余模块(10)包括第一CPU处理器(1)、第一逻辑处理与控制模块(2)和第一总线芯片(3),第二冗余模块(11)包括第二CPU处理器(4)、第二逻辑处理与控制模块(5)和第二总线芯片(6),第三冗余模块(12)包括第三CPU处理器(7)、第三逻辑处理与控制模块(8)和第三总线芯片(9),第一总线芯片(3)的A通道与总线A(13)相连接,第一总线芯片(3)的B通道与总线B(14)相连接,第二总线芯片(6)的A通道与总线A(13)相连接,第二总线芯片(6)的B通道与总线B(14)相连接,第三总线芯片(9)的A通道与总线A(13)相连接,第三总线芯片(9)的B通道与总线B(14)相连接;第一CPU处理器(1)分别与第一逻辑处理与控制模块(2)、第二逻辑处理与控制模块(5)和第三逻辑处理与控制模块(8)相连接;第二CPU处理器(4)分别与第一逻辑处理与控制模块(2)、第二逻辑处理与控制模块(5)和第三逻辑处理与控制模块(8)相连接;第三CPU处理器(7)分别与第一逻辑处理与控制模块(2)、第二逻辑处理与控制模块(5)和第三逻辑处理与控制模块(8)相连接;第一总线芯片(3)分别与第一CPU处理器(1)、第一逻辑处理与控制模块(2)相连接,第二总线芯片(6)分别与第二CPU处理器(4)、第二逻辑处理与控制模块(5)相连接,第三总线芯片(9)分别与第三CPU处理器(7)、第三逻辑处理与控制模块(8)相连接;/n步骤二:基于步骤一建立的三机冗余总线网络计算机系统架构,设计冗余总线的配置方法,默认总线A(13)通信作为主总线,计算机系统上电状态默认第一冗余模块(10)为当班机,第一总线芯片(3)配置为BC模式,第二总线芯片(6)和第三总线芯片(9)均配置为MT模式;/n步骤三:第一冗余模块(10)的第一CPU处理器(1)通过第一总线芯片(3)获取总线消息内容,其中,总线消息内容包括总线命令字、数据内容、状态字与块状态字信息,第一总线芯片(3)的A通道通过总线A(13)发送总线消息内容,第二总线芯片(6)和第三总线芯片(9)同步检测总线上总线消息命令字、数据内容、状态字与块状态字信息,然后第二冗余模块(11)的第二CPU处理器(4)通过第二总线芯片(6)获取总线消息内容,第三冗余模块(12)的第三CPU处理器(7)通过第三总线芯片(9)获取总线消息内容,第一冗余模块(10)、第二冗余模块(11)和第三冗余模块(12)根据状态字和块状态字信息的错误标识,表决当班机即第一冗余模块(10)是否为第一故障,当当班机即第一冗余模块(10)为第一故障时,当班机即第一冗余模块(10)的A通道切换至B通道,当B通道故障时切换回A通道;当当班机即第一冗余模块(10)的A通道和B通道连续一定时间通讯均异常时,则认为当班机即第一冗余模块(10)为第二故障;其中,所述一定时间为20ms;/n步骤四:第二CPU处理器(4)与第三CPU处理器(7)发送总线复位指令,控制第二逻辑处理与控制模块(5)和第三逻辑处理与控制模块(8)执行第一总线芯片(3)的复位电平信号,复位电平信号输出至第一冗余模块(10)的第一CPU处理器(1)及第一总线芯片(3),第一冗余模块(10)重启后配置第一总线芯片(3)为MT模式,第二冗余模块(11)的第二总线芯片(6)配置为BC模式,第三冗余模块(12)的第三总线芯片(9)配置为MT模式,按照当班机切换原则重新组建一个BC模式和两个MT模式的三冗余总线模式。/n
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