[发明专利]在集成电路中形成至少一个电中断的方法及相应集成电路在审

专利信息
申请号: 201710351609.7 申请日: 2017-05-18
公开(公告)号: CN108091576A 公开(公告)日: 2018-05-29
发明(设计)人: C·里韦罗;P·弗纳拉;G·鲍顿;M·利萨特 申请(专利权)人: 意法半导体(鲁塞)公司
主分类号: H01L21/48 分类号: H01L21/48;H01L23/488
代理公司: 北京市金杜律师事务所 11256 代理人: 王茂华;董典红
地址: 法国*** 国省代码: 法国;FR
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摘要: 本申请涉及在集成电路中形成至少一个电中断的方法及相应集成电路。提供一种集成电路,包括在半导体衬底(SB)上方的大量导电焊盘,该大量导电焊盘分别位于该集成电路的部件区与该集成电路的第一金属化层级之间并且包封在绝缘区(RIS2)中,该大量焊盘包括与相应第一部件区(Z1)电接触的第一焊盘(PLT1)以及不与相应第二部件区(Z2)电接触的至少一个第二焊盘,以形成至少一个电中断。
搜索关键词: 集成电路 部件区 电中断 焊盘 导电焊盘 电接触 金属化 绝缘区 包封 层级 衬底 半导体 申请
【主权项】:
1.一种用于在集成电路中形成至少一个电中断的方法,所述方法包括在半导体衬底(SB)上方制造大量导电焊盘,所述大量导电焊盘分别位于所述集成电路的部件区与所述集成电路的第一金属化层级之间并且包封在绝缘区(RIS2)中,所述大量焊盘包括与相应的第一部件区(Z1)电接触的第一焊盘(PLT1)以及不与相应的第二部件区(Z2)电接触的至少一个第二焊盘(PLT2),以形成所述至少一个电中断。
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