[发明专利]一种处理器有效
| 申请号： | 201710448018.1 | 申请日： | 2017-06-14 |
| 公开（公告）号： | CN107340994B | 公开（公告）日： | 2020-11-17 |
| 发明（设计）人： | 刘大力;曹春春 | 申请（专利权）人： | 北京多思安全芯片科技有限公司 |
| 主分类号： | G06F9/30 | 分类号： | G06F9/30 |
| 代理公司： | 北京市隆安律师事务所 11323 | 代理人： | 权鲜枝;何立春 |
| 地址： | 100195 北京市海淀区*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明公开了一种处理器包括：指令队列存储区、配置信息存储区、译码控制单元、显式译码器和隐式译码器；指令队列存储区存储待译码的指令队列；配置信息存储区存储译码约束信息；译码控制单元在每个译码周期开始时，从指令队列存储区中读取多条指令作为当前译码周期的显式指令，并控制显式译码器根据配置信息存储区中的译码约束信息对显式指令进行译码；在当前译码周期结束时将显式指令中被显式译码器译码剩余的指令作为下一个译码周期的隐式指令，在下一个译码周期控制隐式译码器对隐式指令进行译码。本发明实施例通过逻辑电路器件实现了多指令译码，形成了可连续执行的译码控制流，优化了译码设计，提高了指令译码和执行的效率。 | ||
| 搜索关键词： | 一种 处理器 | ||
【主权项】：
一种处理器，其特征在于，包括：指令队列存储区、配置信息存储区、译码控制单元、显式译码器和隐式译码器；所述指令队列存储区用于存储待译码的指令队列；所述配置信息存储区用于存储译码约束信息；所述译码控制单元用于在每个译码周期开始时，从所述指令队列存储区中读取多条指令作为当前译码周期的显式指令，并控制所述显式译码器根据所述配置信息存储区中的译码约束信息对所述显式指令进行译码；在当前译码周期结束时将所述显式指令中被所述显式译码器译码剩余的指令作为下一个译码周期的隐式指令，在下一个译码周期控制所述隐式译码器对所述隐式指令进行译码；所述显式译码器用于对显式指令进行译码；所述隐式译码器用于对隐式指令进行译码。
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