[发明专利]模拟分数N锁相环在审
| 申请号： | 201710475521.6 | 申请日： | 2017-06-21 |
| 公开（公告）号： | CN107528588A | 公开（公告）日： | 2017-12-29 |
| 发明（设计）人： | 王海松;高翔;O·布尔格;C-T·图 | 申请（专利权）人： | 马维尔国际贸易有限公司 |
| 主分类号： | H03L7/18 | 分类号： | H03L7/18 |
| 代理公司： | 北京市金杜律师事务所11256 | 代理人： | 酆迅,辛鸣 |
| 地址： | 巴巴多斯*** | 国省代码： | 暂无信息 |
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| 摘要： | 本申请的各实施例涉及模拟分数N锁相环。一种模拟分数N锁相环，包括振荡器回路，振荡器回路具有参考输入、反馈输入以及回路输出，并且具有被配置用于将回路输出上的信号除以除数的分数反馈除法器。分数反馈除法器的输出被馈送回反馈输入。补偿电路被耦合到参考输入或者反馈输入，并且被配置用于将时间延迟施加到参考输入或者反馈输入以补偿由分数反馈除法器引起的延迟。补偿电路可以是被配置用于将数字延迟信号转换为时间延迟的数字到时间转换器。数字到时间转换器可以被耦合到参考输入以将信号延迟、以匹配由分数反馈除法器引起的反馈延迟，或者可以被耦合到反馈输入以减去时间延迟、以消除由分数反馈除法器引起的反馈延迟。 | ||
| 搜索关键词： | 模拟 分数 锁相环 | ||
【主权项】：
一种模拟分数N锁相环，包括：振荡器回路，所述振荡器回路具有：参考输入、反馈输入以及回路输出，以及分数反馈除法器，所述分数反馈除法器被配置用于将所述回路输出上的信号除以除数，其中所述分数反馈除法器的输出被馈送回所述反馈输入；以及补偿电路，所述补偿电路被耦合到所述参考输入和所述反馈输入中的一个，所述补偿电路被配置用于将时间延迟施加到所述参考输入和所述反馈输入中的所述一个，以补偿由所述分数反馈除法器引起的延迟。
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