[发明专利]双层外延工艺方法有效
申请号: | 201710734293.X | 申请日: | 2017-08-24 |
公开(公告)号: | CN107527792B | 公开(公告)日: | 2019-12-10 |
发明(设计)人: | 伍洲 | 申请(专利权)人: | 上海华虹宏力半导体制造有限公司 |
主分类号: | H01L21/02 | 分类号: | H01L21/02;H01L29/06 |
代理公司: | 31211 上海浦一知识产权代理有限公司 | 代理人: | 郭四华 |
地址: | 201203 上海市浦东*** | 国省代码: | 上海;31 |
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摘要: | 本发明公开了一种双层外延工艺方法,包括步骤:进行第一次外延生长工艺在半导体晶圆表面形成第一外延层;对外延工艺腔进行降温并取出半导体晶圆,在降温过程中,外延工艺腔中的残余工艺气体继续反应在第一外延层表面形成电阻率不匹配外延层;形成第一部分器件结构;将半导体晶圆放置到外延工艺腔中并升温;通入HCL进行外延层刻蚀将第一外延层表面的电阻率不匹配外延层去除;之后进行第二次外延生长工艺形成第二外延层并叠加形成电阻率匹配的双层外延结构;在第二外延层中形成第二部分器件结构。本发明能提高两个叠加的外延层的界面特性,从而提高器件的击穿电压和性能。 | ||
搜索关键词: | 双层 外延 工艺 方法 | ||
【主权项】:
1.一种双层外延工艺方法,其特征在于,包括如下步骤:/n步骤一、将半导体晶圆放置到外延工艺腔中,将所述外延工艺腔升温到第一次外延生长工艺的温度,进行所述第一次外延生长工艺在所述半导体晶圆表面形成具有第一导电类型的第一外延层;/n步骤二、对所述外延工艺腔进行降温并取出形成有所述第一外延层的所述半导体晶圆,在降温过程中,所述外延工艺腔中的残余工艺气体继续反应在所述第一外延层表面形成电阻率不匹配外延层;/n步骤三、在形成有所述电阻率不匹配外延层的所述第一外延层中形成第一部分器件结构;/n步骤四、将形成有所述第一部分器件结构的所述半导体晶圆放置到外延工艺腔中,将所述外延工艺腔升温到第二次外延生长工艺的温度;/n通入HCL进行外延层刻蚀,所述外延层刻蚀将所述第一外延层表面的所述电阻率不匹配外延层去除;/n所述电阻率不匹配外延层去除后关闭HCL的流入从而结束所述外延层刻蚀,之后进行所述第二次外延生长工艺在所述第一外延层表面形成具有第一导电类型的第二外延层;由所述第一外延层和所述第二外延层叠加形成电阻率匹配的具有第一导电类型的双层外延结构;/n步骤五、在所述第二外延层中形成第二部分器件结构。/n
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
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