[发明专利]一种可扩展的可重构多核处理器连接方法在审

专利信息
申请号: 201710826828.6 申请日: 2017-09-14
公开(公告)号: CN107807901A 公开(公告)日: 2018-03-16
发明(设计)人: 胡威;沈欢;蔡熙隆;郭宏;蒋旻;张凯;刘小明;刘俊;王磊;贺娟娟 申请(专利权)人: 武汉科技大学
主分类号: G06F15/78 分类号: G06F15/78
代理公司: 杭州宇信知识产权代理事务所(普通合伙)33231 代理人: 张宇娟
地址: 430081 *** 国省代码: 湖北;42
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摘要: 发明公开了一种可扩展的可重构多核处理器连接方法,包括步骤如下S1、建立可重构片上资源阵列;S2、建立可重构多核的片上网络;S3、在片上网络的连线交叉处配置片上路由器;S4、将可编程逻辑块连接到片上路由器上。本发明的技术方案具有高效性和灵活性,将片上网络与可重构技术结合在一起,通过片上路由器来连接所有的可编程逻辑块,从而使得芯片上不是通过总线,而是通过片上网络来进行连接,减少布线的宽度,提高芯片的利用面积,提供可扩展的片上连接方法。
搜索关键词: 一种 扩展 可重构 多核 处理器 连接 方法
【主权项】:
一种可扩展的可重构多核处理器连接方法,其特征在于,包括步骤如下:S1、建立可重构片上资源阵列:即在具有可重构资源的芯片上按照行和列排列可编程逻辑块,并在相邻可编程逻辑块之间、最后一行可编程逻辑块的下方以及最后一列可编程逻辑块的右方留出布线空间;S2、建立可重构多核的片上网络:即在步骤S1所述的布线空间内进行布线;S3、在片上网络的连线交叉处配置片上路由器:即在每两根连线交叉的位置配置一个片上路由器,片上路由器的数量与可编程逻辑块的数量相等;S4、将可编程逻辑块连接到片上路由器上:即逐个将对应位置的可编程逻辑块与片上路由器连接。
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