[发明专利]控制3D NAND闪存结构中沟道关键尺寸的方法有效

专利信息
申请号: 201711166878.2 申请日: 2017-11-21
公开(公告)号: CN107946311B 公开(公告)日: 2020-09-25
发明(设计)人: 何佳;刘藩东;王鹏;张若芳;夏志良;霍宗亮 申请(专利权)人: 长江存储科技有限责任公司
主分类号: H01L27/1157 分类号: H01L27/1157;H01L27/11578;H01L21/02;H01L21/3065
代理公司: 北京辰权知识产权代理有限公司 11619 代理人: 刘广达
地址: 430074 湖北省武汉市洪山区东*** 国省代码: 湖北;42
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摘要: 发明提供了一种3D NAND闪存结构的沟道刻蚀过程中控制3D NAND闪存结构的沟道关键尺寸的方法,通过在沟道刻蚀工艺前增加湿法清洗的工艺步骤,能够有效清除衬底背面形成的有害的氧化物绝缘材料;由于衬底背面形成的有害的绝缘材料被去除,从而有利于衬底一侧的电极集聚更多的负电荷,进而增强等离子源正负电极之间正、负电荷的吸引力,从而保证等离子源的垂直下行,以使得等离子刻蚀尽量各向异性的垂直于衬底表面向下刻蚀,避免其他方向的无益、甚至是有害刻蚀;基于等离子刻蚀各向异性刻蚀的强化,更便于控制沟道的关键尺寸(CD),从而有效保证了沟道关键尺寸的精度,进而提高了3D NAND闪存的整体性能。
搜索关键词: 控制 nand 闪存 结构 沟道 关键 尺寸 方法
【主权项】:
一种3D NAND闪存结构的沟道刻蚀过程中控制沟道关键尺寸(CD)的方法,包括以下步骤:在衬底表面沉积衬底堆叠结构;为形成顶层选择栅切线进行光刻;为形成顶层选择栅切线进行刻蚀,以形成顶层选择栅切线沟槽;采用原子层沉积工艺对顶层选择栅切线沟槽进行氧化物填充;将原子层沉积工艺在衬底背面形成的氧化物材料去除;沉积沟道刻蚀用硬掩模层;为形成沟道进行光刻;为形成沟道进行刻蚀。
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