[发明专利]一种降低硅空洞缺陷率的硅层减薄方法有效
申请号: | 201711388150.4 | 申请日: | 2017-12-20 |
公开(公告)号: | CN108091558B | 公开(公告)日: | 2020-08-21 |
发明(设计)人: | 王永波 | 申请(专利权)人: | 武汉新芯集成电路制造有限公司 |
主分类号: | H01L21/306 | 分类号: | H01L21/306;H01L21/67;H01L27/146 |
代理公司: | 上海申新律师事务所 31272 | 代理人: | 俞涤炯 |
地址: | 430205 湖北*** | 国省代码: | 湖北;42 |
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摘要: | 本发明提供一种降低硅空洞缺陷率的硅层减薄方法,属于半导体领域,包括:激活操作,于刻蚀腔室内添加一P+类型的第一控片;第一次调节操作,于刻蚀腔室内添加一P‑类型的第二控片;第一次跑货操作,于刻蚀腔室内依次添加多个未经减薄处理的复合结构,利用HHC依次进行刻蚀减薄处理;第二次调节操作,于刻蚀腔室内添加一P‑类型的第三控片;第二次跑货操作,于刻蚀腔室内依次添加多个未经减薄处理的复合结构,利用HHC依次进行刻蚀减薄处理,随后依次取出。本发明的有益效果:通过添加第二控片,优化HHC刻蚀速率,工艺精度更易控制,保证刻蚀厚度达到目标值的同时,降低硅空洞缺陷率,从而提高提高成品良率。 | ||
搜索关键词: | 一种 降低 空洞 缺陷 硅层减薄 方法 | ||
【主权项】:
1.一种降低硅空洞缺陷率的硅层减薄方法,适用于在刻蚀装置中对复合结构中的硅层进行减薄,所述刻蚀装置具有一刻蚀腔室,所述刻蚀腔室内置有HHC,所述复合结构包括所述复合元件及设置在所述复合元件上的所述硅层;其特征在于,所述硅层减薄方法包括:步骤S1、进行激活操作,于所述刻蚀腔室内添加一P+类型的第一控片,随后取出所述第一控片;步骤S2、进行第一次调节操作,于所述刻蚀腔室内添加一P-类型的第二控片,所述第二控片用于中和部分所述第一控片带来的空穴,随后取出所述第二控片;步骤S3、进行第一次跑货操作,于所述刻蚀腔室内依次添加多个未经减薄处理的所述复合结构,利用HHC依次对多个未经减薄处理的所述复合结构中的所述硅层进行刻蚀减薄处理,随后依次取出经过刻蚀减薄后的多个所述复合结构;步骤S4、进行第二次调节操作,于所述刻蚀腔室内添加一P-类型的第三控片,所述第三控片用于中和部分所述HHC在进行刻蚀减薄处理时带来的空穴,随后取出所述第三控片;步骤S5、进行第二次跑货操作,于所述刻蚀腔室内依次添加多个未经减薄处理的所述复合结构,利用HHC依次对多个未经减薄处理的所述复合结构中的所述硅层进行所述刻蚀减薄处理,随后依次取出经过刻蚀减薄后的多个所述复合结构,随后退出。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造