[发明专利]多互连视觉处理器及采用其的图像处理方法有效
| 申请号： | 201711498263.X | 申请日： | 2017-12-29 |
| 公开（公告）号： | CN108053361B | 公开（公告）日： | 2021-08-03 |
| 发明（设计）人： | 王加庆;窦润江;刘力源;吴南健;刘剑 | 申请（专利权）人： | 中国科学院半导体研究所 |
| 主分类号： | G06T1/20 | 分类号： | G06T1/20 |
| 代理公司： | 中科专利商标代理有限责任公司 11021 | 代理人： | 任岩 |
| 地址： | 100083 *** | 国省代码： | 北京;11 |
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| 摘要： | 一种多互连视觉处理器及其处理方法，该视觉处理器包括精简指令集(RISC)处理器模块、系统总线模块、图像数据存储器模块、像素单元(PE)处理器阵列模块、行处理器(RP)阵列模块。其中，所有模块都与系统总线模块连接，精简指令集处理器模块可以通过系统总线模块控制其它模块的工作；图像数据存储器模块、像素单元处理器阵列模块和行处理器阵列模块依次连接；特别地，像素单元处理器阵列和行处理器阵列进行了多互连的设计，有利于加速图像统计特征的计算，最大限度地提高图像直方图的统计速度。本发明结构简单，可广泛应用于需要进行高速图像处理的场合。 | ||
| 搜索关键词： | 互连 视觉 处理器 采用 图像 处理 方法 | ||
【主权项】：
1.一种多互连视觉处理器，其特征在于，所述多互连视觉处理器包括精简指令集处理器模块(1)、系统总线模块(2)、像素单元处理器阵列模块(4)和行处理器阵列模块(5)；其中，精简指令集处理器模块(1)、像素单元处理器阵列模块(4)和行处理器阵列模块(5)均与所述系统总线模块(2)连接，同时像素单元处理器阵列模块(4)和行处理器阵列模块(5)依次连接。
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