[发明专利]可重配置时钟控制装置和系统有效
| 申请号： | 201780007217.7 | 申请日： | 2017-01-17 |
| 公开（公告）号： | CN108475524B | 公开（公告）日： | 2023-07-07 |
| 发明（设计）人： | M·曼苏里;A·马丁;J·A·麦考尔 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G11C11/4076 | 分类号： | G11C11/4076;G11C7/22;H03K3/03;G05F1/575 |
| 代理公司： | 上海专利商标事务所有限公司 31100 | 代理人： | 高见;张欣 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
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| 摘要： | 描述了一种装置，其包括：比较器，该比较器用于通过将由时钟控制电路提供的时钟信号来计时，其中该时钟控制电路包括：多路复用器，该多路复用器被耦合至压控延迟线并且可操作用于将时钟控制电路配置为环形振荡器，其中压控延迟线形成环形振荡器的至少一个延迟区段；以及选择逻辑，该选择逻辑被耦合至多路复用器，该选择逻辑用于接收指示输入时钟的到达的信号，以及用于根据指示来控制多路复用器。还描述了一种装置，其包括：数据路径，该数据路径用于接收输入数据；以及时钟路径，该时钟路径用于接收输入时钟，并且用于在输入时钟不存在时向数据路径提供预处理时钟。 | ||
| 搜索关键词： | 配置 时钟 控制 装置 系统 | ||
【主权项】：
1.一种装置，包括：比较器，所述比较器将通过待由时钟控制电路提供的时钟信号来进行时钟控制，其中所述时钟控制电路包括：压控延迟线，所述压控延迟线具有两个或更多个延迟单元；多路复用器，所述多路复用器被耦合至所述压控延迟线并且能操作用于将所述时钟控制电路配置为环形振荡器，且所述压控延迟线形成所述环形振荡器的至少一个延迟区段；以及选择逻辑，所述选择逻辑被耦合至所述多路复用器，其中所述选择逻辑用于接收指示输入时钟的到达的信号，以及用于根据指示来控制所述多路复用器。
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