[发明专利]采用非选择性外延的自对准锗硅HBT器件的工艺方法有效
申请号: | 201810024872.X | 申请日: | 2018-01-11 |
公开(公告)号: | CN108257868B | 公开(公告)日: | 2021-06-08 |
发明(设计)人: | 周正良 | 申请(专利权)人: | 上海华虹宏力半导体制造有限公司 |
主分类号: | H01L21/331 | 分类号: | H01L21/331;H01L29/737 |
代理公司: | 上海浦一知识产权代理有限公司 31211 | 代理人: | 戴广志 |
地址: | 201203 上海市浦东*** | 国省代码: | 上海;31 |
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摘要: | 本发明公开了一种采用非选择性外延的自对准锗硅HBT器件的工艺方法,在形成集电极后,淀积第一层SiO2层,非选择性生长锗硅外延层;淀积SiO2/多晶硅/SiO2叠层;光刻和干法刻蚀所述SiO2/多晶硅/SiO2叠层;淀积第四层SiO2层,回刻形成侧墙;在有源区选择性生长单晶或多晶硅层,再淀积第五层SiO2层;淀积平坦化的有机介质层;多晶硅顶端的有机介质层和第五层SiO2层去除;将发射极窗口打开;回刻形成内侧墙;在发射极窗口内淀积重掺杂砷多晶硅,然后刻蚀发射极和基极多晶硅形成发射极和基极。本发明能够很简单地和现有的CMOS工艺集成,容易形成适合大规模量产的工艺流程。 | ||
搜索关键词: | 采用 选择性 外延 对准 hbt 器件 工艺 方法 | ||
【主权项】:
1.一种采用非选择性外延的自对准锗硅HBT器件的工艺方法,其特征在于,包括如下步骤:步骤1、在形成集电极后,淀积第一层二氧化硅SiO2层,打开锗硅单晶外延窗口,在去除所述锗硅单晶外延窗口内的二氧化硅SiO2层和清洗后,非选择性生长锗硅外延层;步骤2、在所述锗硅外延层上端,依次淀积第二层二氧化硅SiO2层、多晶硅层、第三层二氧化硅SiO2层,即淀积二氧化硅SiO2/多晶硅/二氧化硅SiO2叠层;步骤3、用牺牲发射极窗口光刻和干法刻蚀所述二氧化硅SiO2/多晶硅/二氧化硅SiO2叠层,停在第三层二氧化硅SiO2层,除发射极区域外其余区域全部刻除;步骤4、淀积第四层二氧化硅SiO2层,回刻形成侧墙,同时要保证多晶硅上有二氧化硅SiO2留存;步骤5、在有源区二氧化硅去除后,侧墙和多晶硅顶部留存二氧化硅SiO2,在有源区选择性生长单晶或多晶硅层,再淀积第五层二氧化硅SiO2层,所述第五层二氧化硅SiO2层覆盖器件的全部上端面;步骤6、在所述第五层二氧化硅SiO2层的上端,淀积平坦化的有机介质层;步骤7、用回刻方法把多晶硅顶端的有机介质层和第五层二氧化硅SiO2层去除;步骤8、干法刻蚀多晶硅,干刻将发射极窗口打开;步骤9、在所述发射极窗口10内淀积氮化硅SiN/二氧化硅SiO2叠层或无定型硅,回刻形成内侧墙;步骤10、湿法刻蚀和清洗所述发射极窗口后,在该发射极窗口内淀积重掺杂砷多晶硅,然后刻蚀发射极和基极多晶硅形成发射极和基极。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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