[发明专利]一种基于数据压缩技术的时间序列信号存储测试装置及方法在审
| 申请号： | 201810026072.1 | 申请日： | 2018-01-11 |
| 公开（公告）号： | CN108198585A | 公开（公告）日： | 2018-06-22 |
| 发明（设计）人： | 周继昆;张荣;邓婷 | 申请（专利权）人： | 中国工程物理研究院总体工程研究所 |
| 主分类号： | G11C11/22 | 分类号： | G11C11/22;G11C29/40 |
| 代理公司： | 北京天奇智新知识产权代理有限公司 11340 | 代理人： | 杨春 |
| 地址： | 621908*** | 国省代码： | 四川;51 |
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| 摘要： | 本发明属于嵌入式存储测试及数据压缩技术领域，具体公开一种基于数据压缩技术的时间序列信号存储测试装置及方法，该装置可以准确有效的记录电子学系统产生的一系列时间动作信号，并提出了一种数据压缩存储算法，采用这种算法进行数据存储，可以极大的减少装置对存储器容量的开销，该装置具有测量精度高、体积小、功耗低、携带方便、存储时间长等优点。 | ||
| 搜索关键词： | 数据压缩技术 存储测试装置 时间序列信号 算法 数据压缩存储 测量精度高 存储器容量 电子学系统 嵌入式存储 动作信号 减少装置 数据存储 携带方便 体积小 功耗 存储 测试 记录 | ||
【主权项】：
1.一种基于数据压缩技术的时间序列信号存储测试装置，其特征在于，包括：光电隔离器，用于将输入的多通道时间序列信号转换为标准电平数字信号；CPLD器件，与所述光电隔离器连接，用于读取标准电平数字信号的高低电平，并将读取到的高低电平按数据压缩算法进行编码；铁电存储器，与所述CPLD器件连接，用于存储编码后的数据；数据回读模块，与所述CPLD器件连接，用于将存储的数据传输到上位机，由上位机对时间序列信号进行恢复还原并显示。
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