[发明专利]一种用于CMOS图像传感器的SAR型ADC结构有效
| 申请号： | 201810267547.6 | 申请日： | 2018-03-28 |
| 公开（公告）号： | CN108495067B | 公开（公告）日： | 2020-11-10 |
| 发明（设计）人： | 郭仲杰;汪西虎;吴龙胜 | 申请（专利权）人： | 西安微电子技术研究所 |
| 主分类号： | H04N5/378 | 分类号： | H04N5/378;H04N5/3745 |
| 代理公司： | 西安通大专利代理有限责任公司 61200 | 代理人： | 徐文权 |
| 地址： | 710065 陕西*** | 国省代码： | 陕西;61 |
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| 摘要： | 本发明公开一种用于CMOS图像传感器的SAR型ADC结构，包括每列单独的列线采样模块和比较器模块，多列共用的DAC模块和SAR逻辑模块；每列的列级比较器模块一输入端连接各自的列采样模块的输出端，另一输入端连接多列共用的DAC模块的输出端，每列的列级比较器模块输出端连接多列共用的SAR逻辑模块，每列通过K次比较实现K位ADC转换；SAR逻辑模块的输出端为ADC结构的输出端。本发明实现了大面阵CMOS图像传感器的高速高精度模数转换，避免了SAR型ADC直接列级化的面积和功耗开销；降低了高精度模拟信号的噪声干扰。 | ||
| 搜索关键词： | 一种 用于 cmos 图像传感器 sar adc 结构 | ||
【主权项】：
1.一种用于CMOS图像传感器的SAR型ADC结构，其特征在于，包括每列单独的列线采样模块和比较器模块，多列共用的DAC模块和SAR逻辑模块；每列的列级比较器模块一输入端连接各自的列采样模块的输出端，另一输入端连接多列共用的DAC模块的输出端，每列的列级比较器模块输出端连接多列共用的SAR逻辑模块，每列通过K次比较实现K位ADC转换；SAR逻辑模块的输出端为ADC结构的输出端。
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