[发明专利]极性码的速率匹配方法及设备有效
| 申请号： | 201810349042.4 | 申请日： | 2017-03-24 |
| 公开（公告）号： | CN108683477B | 公开（公告）日： | 2019-10-22 |
| 发明（设计）人： | 徐晨;张公正;李榕;张华滋;黄凌晨 | 申请（专利权）人： | 华为技术有限公司 |
| 主分类号： | H04L1/00 | 分类号： | H04L1/00 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 518129 广东*** | 国省代码： | 广东;44 |
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| 摘要： | 本申请实施例提供一种极性码的速率匹配方法及设备，该方法包括：根据母码长度N和速率匹配方式进行极化编码，得到极化编码后的编码比特，所述速率匹配方式为第一速率匹配方式或第二速率匹配方式，所述N为正整数；根据所述速率匹配方式对应的比特存储顺序，将所述极化编码后的编码比特存储至循环缓存中，其中，所述第一速率匹配方式与所述第二速率匹配方式对应的比特存储顺序相同；根据所述速率匹配方式对应的比特读取顺序，从所述循环缓存中读取速率匹配的输出序列，所述第一速率匹配方式与所述第二速率匹配方式对应的比特读取顺序不同。本实施例可以降低硬件的复杂度，降低硬件所占的面积。 | ||
| 搜索关键词： | 速率匹配方式 读取 比特存储 极化编码 速率匹配 循环缓存 极性码 输出序列 复杂度 正整数 母码 申请 | ||
【主权项】：
1.一种极性码的速率匹配方法，其特征在于，包括：根据母码长度N和速率匹配方式进行极化编码，得到极化编码后的编码比特，所述速率匹配方式为第一速率匹配方式以及第二速率匹配方式中的一个，所述N为正整数；对所述极化编码后的编码比特进行交织，获得交织后的编码比特；将所述交织后的编码比特按照交织后的比特顺序存储至循环缓存中；从所述循环缓存中按照所述速率匹配方式对应的比特读取的起点位置开始顺序读取M个比特作为输出序列；其中，所述M为目标码长，所述第一速率匹配方式与所述第二速率匹配方式对应的比特读取的起点位置不同；当所述第一速率匹配方式为打孔，则所述打孔对应的比特读取的起点位置为所述循环缓存中交织后的编码比特的第(N‑M+1)位，所述M个比特为从所述循环缓存中交织后的编码比特的第(N‑M+1)位到第N位；当所述第二速率匹配方式为缩短，则所述缩短对应的比特读取的起点位置为所述循环缓存中交织后的编码比特的首位。
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