[发明专利]一种沟槽式MOS势垒肖特基二极管及制造方法在审
申请号: | 201810556259.2 | 申请日: | 2018-06-01 |
公开(公告)号: | CN108550631A | 公开(公告)日: | 2018-09-18 |
发明(设计)人: | 关仕汉;薛涛;迟晓丽 | 申请(专利权)人: | 淄博汉林半导体有限公司 |
主分类号: | H01L29/872 | 分类号: | H01L29/872;H01L29/06;H01L21/329 |
代理公司: | 淄博佳和专利代理事务所 37223 | 代理人: | 孙爱华 |
地址: | 255086 山东省淄博市高*** | 国省代码: | 山东;37 |
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摘要: | 一种沟槽式MOS势垒肖特基二极管及制造方法,属于半导体技术领域。包括沟槽式MOS势垒肖特基芯片以及分别引出的阴极和阳极,包括衬底(6)以及外延层(4),在外延层(4)的表面设置有有源区沟槽(5)和耐压环沟槽(3),其特征在于:芯片切割位置(12)在所述耐压环沟槽(3)的中部,自芯片切割位置(12)切割形成切割面(10),在切割面(10)及上下边缘区有钝化层(16)覆盖。在本沟槽式MOS势垒肖特基二极管及制造方法中,在耐压环沟槽中部进行切割,取消了现有技术中耐压环弯曲弧度部位,提高了芯片的耐压性能,同时只采用一道光刻实现芯片的制造,使工艺复杂程度以及生产成本大大降低。 | ||
搜索关键词: | 沟槽式MOS 耐压 势垒 肖特基二极管 芯片切割 芯片 切割面 外延层 制造 切割 半导体技术领域 阴极 阳极 表面设置 耐压性能 上下边缘 弯曲弧度 钝化层 肖特基 衬底 光刻 源区 生产成本 覆盖 | ||
【主权项】:
1.一种沟槽式MOS势垒肖特基二极管,包括沟槽式MOS势垒肖特基芯片以及自芯片上通过引线(15)分别引出的阴极和阳极,沟槽式MOS势垒肖特基芯片包括衬底(6)以及衬底(6)上方的外延层(4),在外延层(4)的表面设置有有源区沟槽(5)和位于有源区外圈的耐压环沟槽(3),在外延层(4)的表面形成有与引线(15)连接的阳极金属层(1),在衬底(6)的底面形成与引线(15)连接的阴极金属层(8),其特征在于:芯片切割位置(12)在所述耐压环沟槽(3)的中部,自芯片切割位置(12)切割形成切割面(10),在切割面(10)及切割面(10)的上下边缘处覆盖有钝化层(16)。
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