[发明专利]一种计算与存储融合的异构计算硬件加速系统及方法在审
| 申请号： | 201810627987.8 | 申请日： | 2018-06-19 |
| 公开（公告）号： | CN110618963A | 公开（公告）日： | 2019-12-27 |
| 发明（设计）人： | 邱赐云;李礼;叶韬;周正;吴春;王雨雷 | 申请（专利权）人： | 上海威固信息技术股份有限公司 |
| 主分类号： | G06F15/78 | 分类号： | G06F15/78 |
| 代理公司： | 31301 上海海贝律师事务所 | 代理人： | 王文锋 |
| 地址： | 201799 上海市青*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明公开了一种计算与存储融合的异构计算硬件加速系统，包括冯·诺依曼体系结构的计算子系统,FPGA芯片,活跃存储子系统,外部存储系统；FPGA芯片与存储子系统通过高速互联接口通信；冯·诺依曼计算子系统与FPGA芯片，通过高速互联设施通信；FPGA芯片与外部存储系统，通过以太网协议进行通信。本发明通过将计算任务分类，数据在进入活跃存储子系统前采用异构硬件加速单元完成特定的计算，在后续对活跃存储子系统的数据进行处理时，CPU与FPGA协同工作，执行各自擅长的任务，减少数据在计算过程中的行进距离，达到提高计算效率和降低功耗的积极效果。本发明还公开了一种异构计算硬件加速方法，具有上述有益效果。 | ||
| 搜索关键词： | 存储子系统 异构 外部存储系统 计算子系统 高速互联 计算硬件 以太网协议 计算过程 计算效率 加速系统 降低功耗 接口通信 任务分类 体系结构 行进距离 硬件加速 通信 存储 协同 融合 | ||
【主权项】：
1.一种计算与存储融合的异构计算硬件加速系统，其特征在于,包括：/n冯·诺依曼体系结构的计算子系统,现场可编程门阵列FPGA芯片,活跃存储子系统,外部存储系统；其中，计算与存储融合；/n所述FPGA芯片与所述存储子系统通过高速互联接口通信，构成异构硬件加速单元；/n所述冯·诺依曼计算子系统与所述FPGA芯片，通过高速互联设施进行通信；所述的FPGA芯片与所述的外部存储系统，通过以太网协议进行通信；/n所述的FPGA芯片，通过A/D转换接口或JESD204B协议接口与外部数据采集系统通信，完成数据的采集或回放；/n所述的活跃存储子系统，用于存储当前或即将发生的计算任务中需要用到的数据；/n所述的外部存储系统，用于存储长期归档的数据；/n所述计算与存储融合，指采集的数据在存入活跃存储子系统之前，完成了特定的计算，或者从活跃存储子系统读取后，由FPGA完成特定的计算；其中，特定的计算包括重复性计算、具有流水线并行特征的计算,具有I/O通信带宽敏感型的计算，计算密集但逻辑简单的计算。/n
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