[发明专利]数据采集电路、读数据窗口的控制方法及装置有效
| 申请号： | 201810669265.9 | 申请日： | 2018-06-26 |
| 公开（公告）号： | CN110648703B | 公开（公告）日： | 2021-06-15 |
| 发明（设计）人： | 黄帅;王焕东;刘志佳 | 申请（专利权）人： | 龙芯中科技术股份有限公司 |
| 主分类号： | G11C11/4091 | 分类号： | G11C11/4091;G11C11/4076 |
| 代理公司： | 北京同立钧成知识产权代理有限公司 11205 | 代理人： | 张芳;刘芳 |
| 地址： | 100095 北京市海淀*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明提供一种数据采集电路、读数据窗口的控制方法、装置及内存控制器，通过在用于读数据的首个数据选通信号DQS的读前导区域内，确定初始门信号与首个DQS上升沿的相位关系，生成第一门延迟信号；在每个存储体对应的DQS的第一个下降沿，采集第一门延迟信号，得到每个存储体对应的第二门延迟信号的起始位置，生成每个存储体对应的第二门延迟信号；根据每个存储体对应的第二门延迟信号，或者根据第一门延迟信号和每个存储体对应的第二门延迟信号，确定每个存储体对应的读数据窗口。保证了内存控制器对DDRx SDRAM存储器读数据窗口的准确确定，保证了对DDRx存储器数据读取的可靠性。 | ||
| 搜索关键词： | 数据 采集 电路 读数 窗口 控制 方法 装置 | ||
【主权项】：
1.一种数据采集电路，其特征在于，包括：/n延时电路，用于在用于读数据的首个数据选通信号DQS的读前导区域内，确定初始门信号与所述首个DQS上升沿的相位关系，生成第一门延迟信号；/n与所述延时电路连接的下降沿产生门延迟信号电路，所述下降沿产生门延迟信号电路接收每个存储体对应的DQS信号，接收所述延时电路输出的所述第一门延迟信号；在每个存储体对应的DQS的第一个下降沿，采集所述第一门延迟信号，得到每个存储体对应的第二门延迟信号的起始位置，生成每个存储体对应的所述第二门延迟信号；/n与所述下降沿产生门延迟信号电路和所述延时电路连接的选择电路，所述选择电路用于根据每个存储体对应的所述第二门延迟信号，或者根据所述第一门延迟信号和每个存储体对应的所述第二门延迟信号，确定DDRx SDRAM存储器中的每个存储体对应的读数据窗口。/n
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