[发明专利]混合堆叠写驱动器有效
申请号: | 201810755948.6 | 申请日: | 2018-07-11 |
公开(公告)号: | CN109658959B | 公开(公告)日: | 2023-06-20 |
发明(设计)人: | A·桑卡尔;凡卡崔汉文·宾维杰亚拉梵 | 申请(专利权)人: | 马维尔亚洲私人有限公司 |
主分类号: | G11C11/34 | 分类号: | G11C11/34 |
代理公司: | 北京戈程知识产权代理有限公司 11314 | 代理人: | 程伟;王锦阳 |
地址: | 新加坡*** | 国省代码: | 暂无信息 |
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摘要: | 本发明涉及混合堆叠写驱动器,其中,一种电路包括具有存储器单元及位线的存储器阵列。写驱动器通过列选择晶体管与该位线连接。写辅助电路与该写驱动器连接。该写辅助电路包括共同升压节点、负升压晶体管、以及保持晶体管。该负升压晶体管自该数字线连接至该共同升压节点。在针对该存储器阵列的选定单元的写操作期间,该负升压晶体管将该存储器阵列的该选定单元的该位线选择性拉至地。该写辅助电路可包括自第一数字线连接至该共同升压节点的第一负升压晶体管,自第二数字线连接至该共同升压节点的第二负升压晶体管,以及自该共同升压节点连接至地的保持晶体管。 | ||
搜索关键词: | 混合 堆叠 驱动器 | ||
【主权项】:
1.一种电路,包括:存储器阵列,具有存储器单元及位线,该存储器阵列按列排列;数字线,与该存储器阵列的一列的该位线连接;写列选择晶体管,与该数字线连接,从而仅访问选定的位线;写驱动器,与该数字线连接;以及写辅助电路,与该写驱动器连接,其中,该写辅助电路包括共同升压节点、负升压晶体管、以及保持晶体管,其中,该负升压晶体管自该数字线连接至该共同升压节点,以及其中,在针对该存储器阵列的选定单元的写操作期间,该负升压晶体管将该存储器阵列的该选定单元的该数字线选择性拉至地。
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