[发明专利]一种加入随机扰动的多相时钟生成电路在审
| 申请号： | 201810821512.2 | 申请日： | 2018-07-24 |
| 公开（公告）号： | CN109101074A | 公开（公告）日： | 2018-12-28 |
| 发明（设计）人： | 蒲杰;胡刚毅;付东兵;张正平;李梁;李婷;徐代果;徐鸣远;沈晓峰;万贤杰;王友华 | 申请（专利权）人： | 中国电子科技集团公司第二十四研究所 |
| 主分类号： | G06F1/04 | 分类号： | G06F1/04 |
| 代理公司： | 上海光华专利事务所(普通合伙) 31219 | 代理人： | 尹丽云 |
| 地址： | 400060 *** | 国省代码： | 重庆;50 |
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| 摘要： | 本发明公开了一种加入随机扰动的多相时钟生成电路，该时钟生成电路包括主时钟模块、随机信号生成模块和buffer矩阵开关模块；所述主时钟模块用于生成N条多相时钟信号；所述buffer矩阵开关模块用于在所述随机信号生成模块输出的随机控制信号控制下，对输入的所述N条多相时钟信号的传输路径进行随机切换，输出N条加入随机扰动的多相时钟信号。本发明通过加入随机扰动的方式，将时钟相位误差白化，仅仅损失少量信噪比，就能够实时消除多相时钟相位误差对高精度TI ADC性能的影响，且能够跟踪消除时钟相位误差随工作环境变化波动的影响，将固定频率处的误差杂散分量白化到噪底中，不打断TI ADC正常工作，设计实现简单，稳定度高。 | ||
| 搜索关键词： | 随机扰动 多相时钟信号 多相时钟生成电路 矩阵开关模块 时钟相位误差 主时钟模块 生成模块 随机信号 白化 工作环境变化 时钟生成电路 随机控制信号 传输路径 多相时钟 固定频率 相位误差 输出 稳定度 信噪比 杂散 打断 跟踪 | ||
【主权项】：
1.一种加入随机扰动的多相时钟生成电路，其特征在于，该时钟生成电路包括主时钟模块、随机信号生成模块和buffer矩阵开关模块；所述主时钟模块用于生成N条多相时钟信号；所述buffer矩阵开关模块用于在所述随机信号生成模块输出的随机控制信号控制下，对输入的所述N条多相时钟信号的传输路径进行随机切换，输出N条加入随机扰动的多相时钟信号。
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