[发明专利]一种基于查找表的低复杂度近似乘法器有效

专利信息
申请号: 201810933084.2 申请日: 2018-08-16
公开(公告)号: CN109117114B 公开(公告)日: 2023-06-02
发明(设计)人: 贺雅娟;万晨雨;何进;衣溪琳;裴浩然;张波 申请(专利权)人: 电子科技大学
主分类号: G06F7/523 分类号: G06F7/523
代理公司: 成都点睛专利代理事务所(普通合伙) 51232 代理人: 葛启函
地址: 611731 四川省成*** 国省代码: 四川;51
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摘要: 一种基于查找表的低复杂度近似乘法器,属于集成电路技术领域。包括查找表存储模块和近似加法器模块,查找表存储模块包括N个存储单元分别用于存储N个系数,其中第i个存储单元存储的第i个系数为将R位乘数左移i‑1位并在低i‑1位补0形成的R+i‑1位的二进制数;N个存储单元分别由对应的N位被乘数控制,当被乘数的第i‑1位为1时将对应的第i个存储单元存储的第i个系数作为查找表存储模块的第i个输出信号输出到近似加法器模块中,当被乘数的第i‑1位为0时将0作为查找表存储模块的第i个输出信号输出到近似加法器模块中;近似加法器模块将查找表存储模块的N个输出信号相加后产生乘法器的输出信号。本发明解决了输入大位宽时存在的面积过大的问题。
搜索关键词: 一种 基于 查找 复杂度 近似 乘法器
【主权项】:
1.一种基于查找表的低复杂度近似乘法器,所述乘法器的被乘数为N位二进制数,乘数为R位二进制数,其中N和R均为正整数;其特征在于,所述乘法器包括查找表存储模块和近似加法器模块,所述查找表存储模块包括N个存储单元分别用于存储N个系数,其中第i个存储单元存储的第i个系数为将所述R位乘数左移i‑1位并在低i‑1位补0形成的R+i‑1位的二进制数,i为正整数且1≤i≤N;所述N个系数均有符号,第N个系数符号为负,第1至第N‑1个系数符号为正;所述N个存储单元分别由对应的所述N位被乘数控制,所述被乘数的第i‑1位用于控制第i个存储单元;当所述被乘数的第i‑1位为1时将对应的第i个存储单元存储的第i个系数作为所述查找表存储模块的第i个输出信号输出到所述近似加法器模块中,当所述被乘数的第i‑1位为0时将0作为所述查找表存储模块的第i个输出信号输出到所述近似加法器模块中;所述近似加法器模块将所述查找表存储模块的N个输出信号相加后产生所述乘法器的输出信号。
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