[发明专利]一种垂直硅纳米线晶体管的制造工艺方法在审
申请号: | 201811013518.3 | 申请日: | 2018-08-31 |
公开(公告)号: | CN109192662A | 公开(公告)日: | 2019-01-11 |
发明(设计)人: | 顾经纶 | 申请(专利权)人: | 上海华力微电子有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336 |
代理公司: | 上海思微知识产权代理事务所(普通合伙) 31237 | 代理人: | 智云 |
地址: | 201203 上海市浦*** | 国省代码: | 上海;31 |
权利要求书: | 查看更多 | 说明书: | 查看更多 |
摘要: | 本发明提出一种垂直硅纳米线晶体管的制造工艺方法,通过改进原有的垂直硅纳米线晶体管的工艺制造技术,避免了原有技术中垂直硅纳米线晶体管在对源漏进行离子注入时其围栅的阻挡效应,而这种阻挡效应会造成源漏掺杂的不均匀导致器件性能的不对称性,使电路设计及器件可靠性遇到问题。本发明采用了新的工艺步骤,解决了垂直硅纳米线晶体管围栅阻挡了一部分源端离子注入带来的器件结构和特性不对称问题,使垂直硅纳米线晶体管结构和性能能够对称,不依赖于源漏的选择,这样电路设计将大为受益。 | ||
搜索关键词: | 硅纳米线晶体管 垂直 源漏 电路设计 制造工艺 不对称 阻挡 围栅 离子 工艺制造技术 器件可靠性 工艺步骤 器件结构 器件性能 不均匀 掺杂的 原有的 源端 对称 改进 | ||
【主权项】:
1.一种垂直硅纳米线晶体管的制造工艺方法,其特征在于,包括下列步骤:a.通过在硅衬底上进行N型杂质离子注入形成N型重掺杂区域,退火后使用硅气相外延一层单晶硅层;b.对外延的单晶硅层及N型重掺杂区域进行反应离子刻蚀,形成垂直硅纳米线的沟道部分和源端;c.在垂直硅纳米线的硅柱部分热氧化形成一层SiO2薄膜作为栅氧化层,然后化学气相淀积第一介质层,并用反应离子刻蚀回刻得到需要的第一介质层厚度,化学气相淀积多晶硅栅极;d.反应离子刻蚀刻蚀多晶硅露出硅纳米线顶端,得到需要的多晶硅栅厚度,然后进行N型杂质的离子注入形成漏端;e.漏端形成后化学气相淀积第二介质层并用反应离子刻蚀回刻得到需要的第二介质层厚度,高温退火后在顶端化学气相淀积多晶硅层用反应离子刻蚀回刻得到所需厚度;f.然后对顶端多晶硅进行N型杂质的离子注入使N型重掺杂区域与纳米线漏端连成一片形成新的漏端;g.最后是快速热退火和标准金属化工艺。
下载完整专利技术内容需要扣除积分,VIP会员可以免费下载。
该专利技术资料仅供研究查看技术是否侵权等信息,商用须获得专利权人授权。该专利全部权利属于上海华力微电子有限公司,未经上海华力微电子有限公司许可,擅自商用是侵权行为。如果您想购买此专利、获得商业授权和技术合作,请联系【客服】
本文链接:http://www.vipzhuanli.com/patent/201811013518.3/,转载请声明来源钻瓜专利网。
- 同类专利
- 专利分类
H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造