[发明专利]一种用于处理器间双口RAM通信的中断系统有效
| 申请号： | 201811264377.2 | 申请日： | 2018-10-29 |
| 公开（公告）号： | CN109614350B | 公开（公告）日： | 2022-03-15 |
| 发明（设计）人： | 周明杰 | 申请（专利权）人： | 中国航空工业集团公司洛阳电光设备研究所 |
| 主分类号： | G06F13/24 | 分类号： | G06F13/24 |
| 代理公司： | 西北工业大学专利中心 61204 | 代理人： | 金凤 |
| 地址： | 471099 *** | 国省代码： | 河南;41 |
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| 摘要： | 本发明提供了一种用于处理器间双口RAM通信的中断系统，当处理器1和处理器2间通过双口RAM通信时，用于传输中断的FIFO，该FIFO通过FIFO芯片或通过可编程逻辑实现；处理器1通过并行总线连接FIFO的数据写入端口，处理器2通过并行总线连接FIFO的数据读出端口，同时将FIFO的空指示信号EMPTY连接处理器2的外部中断输入端口。本发明提高了处理器间双口RAM通信的实时性，保证中断传递的可靠性和高效性，同时可实现中断共享。 | ||
| 搜索关键词： | 一种 用于 处理器 间双口 ram 通信 中断 系统 | ||
【主权项】：
1.一种用于处理器间双口RAM通信的中断系统，其特征在于：所述的用于处理器间双口RAM通信的中断系统，当处理器1和处理器2间通过双口RAM通信时，用于传输中断的FIFO，该FIFO通过FIFO芯片或通过可编程逻辑实现；处理器1通过并行总线连接FIFO的数据写入端口，处理器2通过并行总线连接FIFO的数据读出端口，同时将FIFO的空指示信号EMPTY连接处理器2的外部中断输入端口；处理器1和处理器2间通过双口RAM通信，当处理器1需要向处理器2传输不同通道的通信数据时，将数据块写入到双口RAM中数据块对应地址中，然后将代表该地址的中断向量写入到FIFO中，FIFO中一旦被写入数据，空指示信号EMPTY无效，该信号触发处理器2的外部中断，处理器2进入中断服务程序后读取FIFO中的中断向量，并根据中断向量从双口RAM中对应地址读取数据，完成中断处理，由于FIFO中的数据被读出，空指示信号EMPTY有效，处理器2的中断自动撤销。
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