[发明专利]半导体器件的制作方法有效
申请号: | 201811309447.1 | 申请日: | 2018-11-05 |
公开(公告)号: | CN109449091B | 公开(公告)日: | 2020-04-10 |
发明(设计)人: | 刘珩 | 申请(专利权)人: | 武汉新芯集成电路制造有限公司 |
主分类号: | H01L21/60 | 分类号: | H01L21/60;H01L27/146 |
代理公司: | 上海思微知识产权代理事务所(普通合伙) 31237 | 代理人: | 屈蘅 |
地址: | 430205 湖北*** | 国省代码: | 湖北;42 |
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摘要: | 本发明提供了一种半导体器件的制作方法,包括:提供键合后的第一晶圆和第二晶圆,所述第一晶圆的第一衬底的背面分布有钝化层;执行光刻及刻蚀工艺形成第一开孔;形成硬掩模层,所述硬掩模层至少覆盖所述第一开孔的侧壁表面;执行刻蚀工艺,形成第二开孔;执行光刻及刻蚀工艺,形成第三开孔;以及,形成互连层,互连层通过三个开孔与第二金属层和第一金属层电连接。第一衬底的背面分布有钝化层,形成第一开孔后,在所述第一开孔的侧壁表面形成硬掩模层,执行无掩模刻蚀工艺,形成第二开孔,简化了工艺,省去了一层光罩,降低了生产成本。 | ||
搜索关键词: | 半导体器件 制作方法 | ||
【主权项】:
1.一种半导体器件的制作方法,其特征在于,包括:提供键合后的第一晶圆和第二晶圆,所述第一晶圆包括第一衬底、位于所述第一衬底的正面的第一介质层和嵌设于所述第一介质层中的第一金属层,所述第二晶圆包括第二衬底、位于所述第二衬底上的第二介质层和嵌设于所述第二介质层中的第二金属层,所述第一介质层面向所述第二介质层,所述第一衬底的背面分布有钝化层;执行光刻及刻蚀工艺,形成第一开孔,所述第一开孔贯穿所述钝化层和所述第一衬底,所述第一开孔位于所述第一金属层和第二金属层上方;形成硬掩模层,所述硬掩模层至少覆盖所述第一开孔的侧壁表面;执行刻蚀工艺,形成第二开孔,所述第二开孔贯穿所述第一开孔底部部分厚度的所述第一介质层,所述第二开孔位于所述第一金属层上方;形成所述第二开孔的刻蚀工艺中,对所述钝化层的刻蚀速率小于对所述硬掩模层的刻蚀速率;执行光刻及刻蚀工艺,形成第三开孔,所述第三开孔贯穿所述第二开孔底部的所述第一介质层和部分厚度的所述第二介质层,所述第三开孔位于所述第二金属层上方;执行刻蚀工艺,暴露所述第一金属层和第二金属层;以及,形成互连层,所述互连层通过所述第一开孔、第二开孔和第三开孔与所述第二金属层和第一金属层电连接。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造