[发明专利]多FPGA拓扑的互联检测与延时测量方法在审
| 申请号： | 201811385432.3 | 申请日： | 2018-11-20 |
| 公开（公告）号： | CN109669824A | 公开（公告）日： | 2019-04-23 |
| 发明（设计）人： | 李小波;李永超;刘志超;何鹏 | 申请（专利权）人： | 中科曙光信息产业成都有限公司;成都海光集成电路设计有限公司 |
| 主分类号： | G06F11/22 | 分类号： | G06F11/22 |
| 代理公司： | 北京兰亭信通知识产权代理有限公司 11667 | 代理人： | 赵永刚 |
| 地址： | 610015 四川省成都*** | 国省代码： | 四川;51 |
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| 摘要： | 本发明提供一种多FPGA拓扑的互联检测与延时测量方法。所述方法包括：根据路由配置表配置所述多FPGA拓扑中的所有FPGA的I/O端口；所有FPGA通过配置的I/O端口并行发送固定序列至对应FPGA，并接收所述对应FPGA反馈的响应序列；各个FPGA根据接收到的所述响应序列记录自身与所述对应FPGA之间的端口延时信息和端口联通信息。本发明能够快速定位多FPGA拓扑之间的联通性错误，以及准确测量互联线的延时。 | ||
| 搜索关键词： | 拓扑 响应序列 延时测量 互联 并行发送 固定序列 快速定位 路由配置 延时信息 准确测量 表配置 互联线 联通性 配置的 检测 联通 延时 反馈 记录 | ||
【主权项】：
1.一种多FPGA拓扑的互联检测与延时测量方法，其特征在于，包括：(1)从起点FPGA开始，当前FPGA通过全部I/O端口发送包括固定序列至至少一个下一级相邻FPGA；(2)所述至少一个下一级相邻FPGA接收到所述固定序列后解析所述固定序列中的命令码，并发送响应序列至所述当前FPGA；(3)所述当前FPGA接收到所述响应序列后解析所述响应序列中的响应码，如果在规定时间内接收到所述响应码，则判定所述当前FPGA和所述至少一个下一级相邻FPGA中的各个FPGA之间的对应端口联通，并根据所述响应序列记录自身与所述至少一个下一级相邻FPGA中的各个FPGA之间的端口延时信息和端口联通信息；(4)所述当前FPGA在记录完所述端口延时信息和端口联通信息之后按照广度优先原则触发对应FPGA作为所述当前FPGA重复上述步骤，直至遍历所有FPGA。
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