[发明专利]晶体管和用于制作晶体管的方法有效

专利信息
申请号: 201811419446.2 申请日: 2015-01-07
公开(公告)号: CN109461702B 公开(公告)日: 2023-10-03
发明(设计)人: J·H·张 申请(专利权)人: 意法半导体公司
主分类号: H01L21/8238 分类号: H01L21/8238;H01L29/10;H01L21/336;H01L29/786;H01L29/165;H01L29/78
代理公司: 北京市金杜律师事务所 11256 代理人: 王茂华;董典红
地址: 美国得*** 国省代码: 暂无信息
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摘要: 发明涉及晶体管和用于制作晶体管的方法。在提供有掩埋氧化层(BOX)的绝缘体上硅(SOI)半导体晶片上,例如FD‑SOI和UTBB器件,构造具有部分凹陷栅极的晶体管。外延生长的沟道区域放松了对掺杂源极和漏极分布的设计的约束。部分凹陷栅极和抬升的外延的源极和漏极区域的形成允许进一步地改善晶体管性能和降低比如漏极致势垒降低(DIBL)的短沟道效应,以及控制特有的亚阈值斜率。由先进工艺控制协助,可以变化栅极凹陷以相对于掺杂分布将沟道置于不同的深度。部分凹陷栅极具有最初与栅极的三个侧面相接触地形成的相关的高k栅极电介质。随后去除高k侧壁以及用更低k的氮化硅封料替代降低了在栅极与源极和漏极区域之间的电容。
搜索关键词: 晶体管 用于 制作 方法
【主权项】:
1.一种晶体管,包括:半导体衬底,其中具有掩埋绝缘层;漏极区域,向下延伸到所述掩埋绝缘层;源极区域,向下延伸到所述掩埋绝缘层,其中所述源极区域和所述漏极区域在所述衬底的顶表面之上延伸;外延沟道,在所述源极区域和所述漏极区域之间延伸;栅极堆叠,部分凹陷到在所述衬底的所述顶表面之下的凹陷深度,所述栅极堆叠包括:栅极电介质,与所述外延沟道接触,所述栅极电介质具有电介质长度;和金属栅极,具有栅极长度,所述栅极长度超过所述电介质长度一距离,所述距离限定底切区域;以及单个连续封料,与所述金属栅极的顶表面、侧壁和底侧接触,所述封料被定位于所述底切区域中。
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