[实用新型]一种全频段全制式信号干扰装置有效

专利信息
申请号: 201821798407.3 申请日: 2018-11-02
公开(公告)号: CN208924257U 公开(公告)日: 2019-05-31
发明(设计)人: 牛增强;唐文成;李保庆;朱道伟;姜晓健;闻天 申请(专利权)人: 济南爱我本克网络科技有限公司
主分类号: H04K3/00 分类号: H04K3/00
代理公司: 济南诚智商标专利事务所有限公司 37105 代理人: 李修杰
地址: 250000 山东省济南市高*** 国省代码: 山东;37
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摘要: 本申请公开了一种全频段全制式信号干扰装置,该装置主要包括扫频单元、基带单元、射频发射器、拨码开关和主控单元,主控单元分别与扫频单元、基带单元、射频发射器以及拨码开关连接,基带单元的输入端与扫频单元连接,基带单元的输出端与射频发射器连接。扫频单元包括第一数字信号处理器和第一存储器;基带单元包括FPGA接口电路、用于解码的FPGA模块和第二数字信号处理器。本申请中的装置,对不同频点信号进行屏蔽的针对性强、灵活性高、屏蔽效率高,能够实现全频段全制式的信号屏蔽,而且功耗低,有利于降低对人体的伤害。
搜索关键词: 基带单元 扫频 射频发射器 全频段 全制式 数字信号处理器 拨码开关 信号干扰 主控单元 屏蔽 存储器 解码 单元连接 频点信号 信号屏蔽 输出端 输入端 功耗 申请 电路 伤害
【主权项】:
1.一种全频段全制式信号干扰装置,其特征在于,信号干扰装置包括:扫频单元、基带单元、射频发射器、拨码开关和主控单元,主控单元分别与扫频单元、基带单元、射频发射器以及拨码开关连接,基带单元的输入端与扫频单元连接,基带单元的输出端与射频发射器连接;扫频单元包括,扫描当前工作环境中公网信号频点并生成频点列表的第一数字信号处理器、存储频点列表的第一存储器;基带单元包括,用于和主控单元进行连接的FPGA接口电路、用于解码的FPGA模块和第二数字信号处理器,FPGA模块的输入端与扫频单元连接,FPGA模块的输出端分别与第二数字信号处理器以及射频发射器连接。
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