[实用新型]用于高密度面阵性能验证的测试结构有效
申请号: | 201821916462.8 | 申请日: | 2018-11-21 |
公开(公告)号: | CN209150051U | 公开(公告)日: | 2019-07-23 |
发明(设计)人: | 于春蕾;李雪;邵秀梅;龚海梅 | 申请(专利权)人: | 中国科学院上海技术物理研究所 |
主分类号: | H01L21/66 | 分类号: | H01L21/66 |
代理公司: | 上海沪慧律师事务所 31311 | 代理人: | 郭英 |
地址: | 200083 *** | 国省代码: | 上海;31 |
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摘要: | 本专利公开了一种用于高密度面阵性能验证的测试结构,所述结构包括半绝缘InP衬底、N型InP缓冲层、InGaAs吸收层、N型InP帽层、光敏区、P电极、N电极。光敏区由18组有效面积为60μmⅹ60μm的探测器光敏元阵列组成,每组探测器阵列共同引出一个P电极,所有探测器阵列共用一个N电极。本专利的优点在于:1、通过测试结构的制备和测试,可以对比不同阵列设计的性能,为大面阵设计提供理论依据;2、中心距较小的面阵测试复杂,且测试结果受到其他因素影响,而本专利公布的测试结构测试步骤简便易操作,可以直接得到面阵的性能参数。 | ||
搜索关键词: | 测试结构 探测器阵列 高密度面 性能验证 光敏区 面阵 测试 测试步骤 性能参数 因素影响 有效面积 阵列设计 半绝缘 大面阵 光敏元 吸收层 中心距 探测器 衬底 帽层 制备 | ||
【主权项】:
1.一种用于高密度面阵性能验证的测试结构,包括半绝缘InP衬底(1)、N型InP缓冲层(2)、InGaAs吸收层(3)、N型InP帽层(4)、光敏区(5)、P电极(6)、N电极(7),其特征在于:光敏区(5)由18组有效面积为60μmⅹ60μm的探测器光敏元阵列组成,每组探测器阵列共同引出一个P电极,所有探测器阵列共用一个N电极;所述的光敏元阵列中,第1‑6组阵列规模为6ⅹ6,扩散孔中心距为10μm,其中第1‑3组扩散孔形状为方形,边长分别为3μm、4μm、5μm;第4‑6组扩散孔形状为圆形,直径分别为3μm、4μm、5μm;第7‑12组阵列规模为4ⅹ4,扩散孔中心距为15μm,其中第7‑9组扩散孔形状为方形,边长分别为8μm、9μm、10μm;第10‑12组扩散孔形状为圆形,直径分别为8μm、9μm、10μm;第13‑18组阵列规模为3ⅹ3,扩散孔中心距为20μm,其中第13‑15组扩散孔形状为方形,边长分别为13μm、14μm、15μm;第16‑18组扩散孔形状为圆形,直径分别为13μm、14μm、15μm。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造