[实用新型]基于POWER PC处理器的处理器子卡有效

专利信息
申请号: 201822197548.6 申请日: 2018-12-25
公开(公告)号: CN209312010U 公开(公告)日: 2019-08-27
发明(设计)人: 邵忠俊;孙小杰;许征锋;余齐严;尹晓明 申请(专利权)人: 西安翔迅科技有限责任公司
主分类号: G06F11/07 分类号: G06F11/07;G06F13/38
代理公司: 西安智邦专利商标代理有限公司 61211 代理人: 胡乐
地址: 710077 陕西省西安市锦业二路*** 国省代码: 陕西;61
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摘要: 实用新型提出一种基于POWER PC处理器的处理器子卡,能够解决现有基于POWERPC架构的板卡结构尺寸、功耗以及重量较大的问题。该处理器子卡中,CPLD接入看门狗电路,实现主处理器复位以及相应的配置;CPLD还用于对主处理器经LPC总线传输的地址和数据进行解析;主处理器配置有PCI接口,相应通过PCI总线接至PMC规范定义的连接器X1和X2;CPLD配置有多路离散量输入输出接口,相应通过电平缓冲芯片接至连接器X4;所述连接器X4同时还作为串口接口电路、以太网接口电路、USB接口电路、CAN总线接口电路以及电源电路对外的接口。
搜索关键词: 连接器 处理器子卡 主处理器 以太网接口电路 串口接口电路 输入输出接口 本实用新型 看门狗电路 板卡结构 电平缓冲 电源电路 离散量 复位 多路 功耗 配置 解析 架构 芯片 传输
【主权项】:
1.基于POWER PC处理器的处理器子卡,其特征在于:包括主处理器及其外围电路、看门狗电路、电源电路、串口接口电路、以太网接口电路、USB接口电路和CAN总线接口电路;其中:主处理器为MPC5121e系列的32位PowerPC微控制器,并配置有可扩展的DDR2;主处理器的外围电路包括时钟模块、BOOT FLASH、USER FLASH、NVRAM和CPLD;时钟模块为主处理器和CPLD提供同步时钟信号;BOOT FLASH、USER FLASH和NVRAM分别一端与CPLD连接,另一端与主处理器的LPC总线连接;CPLD接入看门狗电路,实现主处理器复位以及相应的配置;CPLD还用于对主处理器经LPC总线传输的地址和数据进行解析;串口接口电路、以太网接口电路、USB接口电路、CAN总线接口电路分别与主处理器的相应通信接口连接;所述主处理器配置有PCI接口,相应通过PCI总线接至PMC规范定义的连接器X1和X2;所述CPLD配置有多路离散量输入输出接口,相应通过电平缓冲芯片接至连接器X4;所述连接器X4同时还作为串口接口电路、以太网接口电路、USB接口电路、CAN总线接口电路以及电源电路对外的接口。
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