[发明专利]用于针对低密度奇偶校验（LDPC）码进行快速分层解码的系统和方法在审
| 申请号： | 201880017296.4 | 申请日： | 2018-01-09 |
| 公开（公告）号： | CN110431751A | 公开（公告）日： | 2019-11-08 |
| 发明（设计）人： | A.席拉齐尼亚;M.马尔姆贝格;S.桑德贝格;M.安德森 | 申请（专利权）人： | 瑞典爱立信有限公司 |
| 主分类号： | H03M13/11 | 分类号： | H03M13/11 |
| 代理公司： | 中国专利代理(香港)有限公司 72001 | 代理人： | 李啸;杨美灵 |
| 地址： | 瑞典斯*** | 国省代码： | 瑞典;SE |
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| 摘要： | 根据某些实施例，提供一种用于针对具有至少包括第一层和第二层的奇偶校验矩阵(PCM)的低密度奇偶校验(LDPC)码进行快速分层解码的方法。该方法包括从存储器读取变量节点(VN)软信息，其中VN软信息与从VN到PCM的第二层的校验节点(CN)的消息相关联。根据PCM的第二层的CN演算新的CN到VN消息。针对VN演算新的VN软信息。基于VN软信息以及从第一层的CN到VN的新的CN到VN消息和从第一层的CN到VN的旧的CN到VN消息来演算新的VN软信息，使得新的VN软信息的更新被延迟至少一个层。快速分层解码比标准分层解码技术具有更低的解码等待时间并且更高效地利用解码硬件。这可通过使存储器存取和处理硬件单元同时保持活动以便避免过多的解码等待时间来实现。更具体来说，某些实施例可同时实行存储器存取和计算过程，而无需任何努力来使行层彼此相互正交。另一个技术优点可以是，提出的解码算法调整LLR以便部分地解决由于非正交行引起的从分层解码的偏离。 | ||
| 搜索关键词： | 软信息 分层解码 演算 第一层 低密度奇偶校验 存储器存取 解码 奇偶校验矩阵 存储器读取 变量节点 处理硬件 技术优点 计算过程 解码算法 解码硬件 校验节点 非正交 正交 延迟 偏离 关联 更新 | ||
【主权项】：
1.一种用于针对具有至少包括第一层和第二层的奇偶校验矩阵(PCM)的低密度奇偶校验(LDPC)码进行快速分层解码的方法，所述方法包括：从存储器读取变量节点(VN)软信息，其中所述VN软信息与从VN到所述PCM的所述第二层的校验节点(CN)的消息相关联；根据所述PCM的所述第二层的所述CN演算新的CN到VN消息；以及针对所述VN演算新的VN软信息，其中基于所述VN软信息以及从所述第一层的CN到所述VN的新的CN到VN消息和从所述第一层的所述CN到所述VN的旧的CN到VN消息来演算所述新的VN软信息，使得新的VN软信息的所述更新被延迟至少一个层。
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