[发明专利]多核系统的内连线结构有效
| 申请号： | 201910001320.1 | 申请日： | 2019-01-02 |
| 公开（公告）号： | CN109739785B | 公开（公告）日： | 2020-12-29 |
| 发明（设计）人： | 江文彬 | 申请（专利权）人： | 威盛电子股份有限公司 |
| 主分类号： | G06F13/28 | 分类号： | G06F13/28 |
| 代理公司： | 北京林达刘知识产权代理事务所(普通合伙) 11277 | 代理人： | 刘新宇 |
| 地址： | 中国台湾新北*** | 国省代码： | 台湾;71 |
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| 摘要： | 一种多核系统的内连线结构，该内连线结构包括多个第一运算核、第一环状总线、直接存储器存取引擎以及直接存储器存取环状控制器。第一运算核连接至第一环状总线。直接存储器存取环状控制器将直接存储器存取引擎连接至第一环状总线。第一运算核通过第一环状总线与直接存储器存取引擎通信，并使直接存储器存取引擎进行存储器操作。本发明可提升直接存储器存取的工作效率，且加快直接存储器存取引擎与各个运算核之间的通信速度。 | ||
| 搜索关键词： | 多核 系统 连线 结构 | ||
【主权项】：
1.一种多核系统的内连线结构，其特征在于，包括：多个第一运算核；第一环状总线，其中所述第一运算核连接至所述第一环状总线；直接存储器存取引擎；以及直接存储器存取环状控制器，用以将所述直接存储器存取引擎连接至所述第一环状总线，其中，所述第一运算核通过所述第一环状总线与所述直接存储器存取引擎通信，并使所述直接存储器存取引擎进行存储器操作。
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