[发明专利]三维存储器及其制作方法及半导体器件的制作方法有效
申请号: | 201910035718.7 | 申请日: | 2019-01-15 |
公开(公告)号: | CN109671716B | 公开(公告)日: | 2021-02-12 |
发明(设计)人: | 赵治国;霍宗亮;叶甜春 | 申请(专利权)人: | 中国科学院微电子研究所 |
主分类号: | H01L27/11582 | 分类号: | H01L27/11582;H01L27/1157 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 姚璐华;王宝筠 |
地址: | 100029 北京市朝阳*** | 国省代码: | 北京;11 |
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摘要: | 本发明公开了一种三维存储器及其制作方法及半导体器件的制作方法,本发明技术方案通过在刻蚀孔的侧壁形成过渡层,将过渡层以及刻蚀孔的部分侧壁转换为第一介质层,过渡层的厚度由刻蚀孔的顶部至底部逐渐减小,可以使得靠近刻蚀孔底部的过渡层与其覆盖较厚的侧壁同时转换为第一介质层,靠近刻蚀孔顶部的过渡层与其覆盖的较薄的侧壁同时转换为第一介质层,从而形成满足厚度均匀条件的第一介质层,使得刻蚀孔的侧壁满足垂直条件,从而形成质量较好的垂直通孔。基于上述方案制作三维存储器,可以使得三维存储器具有满足垂直条件的沟道孔,且在沟道孔侧壁形成满足厚度均匀条件的栅氧化层,提高三维存储器中不同存储单元的电压分布均匀性。 | ||
搜索关键词: | 三维 存储器 及其 制作方法 半导体器件 | ||
【主权项】:
1.一种三维存储器的制作方法,其特征在于,所述制作方法包括:提供一半导体衬底,所述半导体衬底形成有堆叠结构;在所述堆叠结构上形成沟道孔,所述沟道孔露出所述半导体衬底,所述沟道孔的宽度由顶部至底部逐渐减小;在所述沟道孔的底部形成外延层;在所述沟道孔的侧壁以及所述外延层的表面形成过渡层,所述过渡层的厚度由所述沟道孔的顶部至底部逐渐减小;将所述过渡层以及所述沟道孔的部分侧壁转换为栅氧化层,所述栅氧化层满足厚度均匀条件,使得所述沟道孔的侧壁满足垂直条件;在所述沟道孔内形成沟道孔结构。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
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H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
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H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的