[发明专利]一种自适应并行时钟序列检测装置及方法有效
| 申请号： | 201910151248.0 | 申请日： | 2019-02-28 |
| 公开（公告）号： | CN109726162B | 公开（公告）日： | 2022-03-18 |
| 发明（设计）人： | 汪欣;沈剑良;刘勤让;宋克;杨堃;吕平;李沛杰;朱珂;陈艇;张丽;丁旭;汤先拓;赵博;张文建;王晓雪 | 申请（专利权）人： | 天津芯海创科技有限公司;天津市滨海新区信息技术创新中心 |
| 主分类号： | G06F13/40 | 分类号： | G06F13/40;G06F13/42 |
| 代理公司： | 天津滨海科纬知识产权代理有限公司 12211 | 代理人： | 杨慧玲 |
| 地址： | 300457 天津市滨海新*** | 国省代码： | 天津;12 |
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| 摘要： | 本发明提供了一种自适应并行时钟序列检测装置及方法，装置包括时钟序列，并行连接第一选通器和第二选通器，第一选通器连接PCIe时钟序列检测单元，第二选通器连接RapidIO时钟序列检测单元，PCIe时钟序列检测单元一方面连接第三选通器，另一方面连接第一逻辑电路，第一逻辑电路一方面通过第二反相器连接RapidIO时钟序列检测单元，另一方面连接第二选通器；RapidIO时钟序列检测单元一方面连接第三选通器，另一方面连接第二逻辑电路，第二逻辑电路一方面通过第一反相器连接PCIe时钟序列检测单元，另一方面连接第一选通器。本发明可以兼容检测RapidIO、PCIe协议时钟补偿序列，提高硬件结构可重用性。 | ||
| 搜索关键词： | 一种 自适应 并行 时钟 序列 检测 装置 方法 | ||
【主权项】：
1.一种自适应并行时钟序列检测装置，其特征在于：包括时钟序列输入端，所述时钟序列输入端并行连接第一选通器和第二选通器的输入端，所述第一选通器的输出端连接PCIe时钟序列检测单元的输入端，所述第二选通器的输出端连接RapidIO时钟序列检测单元的输入端；所述PCIe时钟序列检测单元的输出端一方面连接第三选通器的输入端，用于输出检测数据，另一方面连接第一逻辑电路，通过第一逻辑电路产生PCIe协议指示信号，所述第一逻辑电路的输出端一方面通过第二反相器连接RapidIO时钟序列检测单元的输入端，另一方面连接第二选通器的控制输入端；所述RapidIO时钟序列检测单元的输出端一方面连接第三选通器的输入端，用于输出检测数据，另一方面连接第二逻辑电路，通过第二逻辑电路产生RapidIO协议指示信号，所述第二逻辑电路的输出端一方面通过第一反相器连接PCIe时钟序列检测单元的输入端，另一方面连接第一选通器的控制输入端；所述第一逻辑电路的输出端还连接第三或门电路的第一输入端，所述第二逻辑电路的输出端还通过第三反相器连接第三或门电路的第二输入端，所述第三或门电路的输出端连接第三选通器的控制输入端。
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