[发明专利]用于降低数字时钟频率误差的方法、装置、计算机设备及存储介质有效
申请号: | 201910242873.6 | 申请日: | 2019-03-28 |
公开(公告)号: | CN110007712B | 公开(公告)日: | 2020-12-01 |
发明(设计)人: | 李湘锦;张鹏;董怀玉;王宏伟 | 申请(专利权)人: | 深圳忆联信息系统有限公司 |
主分类号: | G06F1/04 | 分类号: | G06F1/04 |
代理公司: | 深圳市精英专利事务所 44242 | 代理人: | 冯筠 |
地址: | 518067 广东省深圳市南山区*** | 国省代码: | 广东;44 |
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摘要: | 本发明公开了用于降低数字时钟频率误差的方法、装置、计算机设备及存储介质,其中方法包括配置控制器参数;进入校准模式;查询校准是否完成;若是,则将保存的主延时的延时值写入参数寄存器中;配置参数寄存器进入时钟振荡模式,以根据主延时的延时值生成内部时钟;关闭外部晶振时钟。本发明通过内部时钟门控生成参考时钟,然后将配置前延时的参数所生成前延时内部时钟根据参考时钟进行锁相,锁相完成之后,则将根据主延时的延时值生成内部时钟,得到内部时钟之后,则可以关闭外部的晶振时钟,从而达到了降低功耗以及降低数字时钟频率误差的目的。 | ||
搜索关键词: | 用于 降低 数字 时钟 频率 误差 方法 装置 计算机 设备 存储 介质 | ||
【主权项】:
1.用于降低数字时钟频率误差的方法,其特征在于,所述方法包括:配置控制器参数;进入校准模式;查询校准是否完成;若是,则将保存的主延时的延时值写入参数寄存器中;配置参数寄存器进入时钟震荡模式,以根据主延时的延时值生成内部时钟;关闭外部晶振时钟。
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