[发明专利]加解密处理方法及装置在审
申请号: | 201910450058.9 | 申请日: | 2019-05-28 |
公开(公告)号: | CN112015564A | 公开(公告)日: | 2020-12-01 |
发明(设计)人: | 范玉庆;和艳丽;陈晓科 | 申请(专利权)人: | 普天信息技术有限公司 |
主分类号: | G06F9/54 | 分类号: | G06F9/54;G06F9/50;H04L29/06 |
代理公司: | 北京路浩知识产权代理有限公司 11002 | 代理人: | 王莹;李相雨 |
地址: | 100080 北京*** | 国省代码: | 北京;11 |
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摘要: | 本发明实施例提供一种加解密处理方法及装置,所述方法包括:ARM模块通过专用消息队列将待加解密数据发送到DSP模块;DSP模块按照预设传输速率将所述待加解密数据发送到FPGA模块;FPGA模块对所述待加解密数据进行加解密处理,再将经过加解密处理之后的数据写入所述ARM模块和所述DSP模块之间的共享内存中。本发明实施例提供的加解密处理方法及装置,组合使用硬件分配的专用消息队列通道和共享内存通道进行加解密前后数据的传输,避免了网络风暴导致FPGA出现硬件异常,同时,又提高了加解密处理的速率,降低了对业务数据通道资源的占用,减小了系统开支。 | ||
搜索关键词: | 解密 处理 方法 装置 | ||
【主权项】:
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