[发明专利]纠错码存储器安全性在审
| 申请号： | 201910451065.0 | 申请日： | 2019-05-28 |
| 公开（公告）号： | CN110659153A | 公开（公告）日： | 2020-01-07 |
| 发明（设计）人： | A·博洛托夫;M·格林竹;R·阿加瓦尔 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G06F11/10 | 分类号： | G06F11/10 |
| 代理公司： | 72002 永新专利商标代理有限公司 | 代理人： | 刘瑜;王英 |
| 地址： | 美国加*** | 国省代码： | 美国;US |
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| 摘要： | 本文描述了用于纠错码(ECC)存储器安全性的系统和技术。接收包含数据的写入请求。针对数据计算完整性检查值(ICV)。然后，执行写入请求，包括将数据的表示写入存储器中的数据区域，并且将ICV写入存储器中的ECC区域。这里，数据区域可由主机寻址，并且ECC区域经由存储器的硬件对应于数据区域。 | ||
| 搜索关键词： | 存储器 数据区域 写入请求 写入 完整性检查 数据计算 纠错码 寻址 主机 | ||
【主权项】：
1.一种用于纠错码(ECC)存储器安全性的存储器控制器，所述存储器控制器包括：/n包括指令的机器可读介质；以及/n处理电路系统，其在执行所述指令时操作以用于：/n接收写入请求，所述写入请求包括数据；/n计算所述数据的完整性检查值(ICV)；/n执行所述写入请求包括：/n将所述数据的表示写入存储器中的数据区域，所述数据区域可由主机寻址；以及/n将所述ICV写入存储器中的ECC区域，所述ECC区域经由所述存储器的硬件对应于所述数据区域。/n
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