[发明专利]一种面向嵌入式平台的分组卷积过程优化方法在审

专利信息
申请号: 201910804453.2 申请日: 2019-08-28
公开(公告)号: CN110516796A 公开(公告)日: 2019-11-29
发明(设计)人: 王继禾;黄澍;赵佳祥;刘君;侯雨珊 申请(专利权)人: 西北工业大学
主分类号: G06N3/04 分类号: G06N3/04;G06N3/063;G06N3/08
代理公司: 61204 西北工业大学专利中心 代理人: 刘新琼<国际申请>=<国际公布>=<进入
地址: 710072 *** 国省代码: 陕西;61
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摘要: 发明涉及一种面向嵌入式平台的分组卷积过程优化方法,根据嵌入式设备的资源(计算、存储能力)情况进行动态调整每组的通道数,使嵌入式设备的资源得到充分利用,当嵌入式设备可用的资源不能满足传统分组卷积,则采用数据合并算法,通过输入通道的合并,进一步减少了网络的计算量,使其能够满足嵌入式设备资源受限的情况,极大地提升了计算效率;当嵌入式设备可用的资源除了满足传统分组卷积还有剩余,则采用数据选择算法,使其可以最大化使用嵌入式平台的硬件资源,进一步提升网络模型的精度。
搜索关键词: 嵌入式设备 卷积 嵌入式平台 分组 可用 数据合并算法 存储能力 动态调整 过程优化 计算效率 输入通道 数据选择 网络模型 硬件资源 资源受限 计算量 通道数 最大化 算法 合并 网络
【主权项】:
1.一种面向嵌入式平台的分组卷积过程优化方法,其特征在于步骤如下:/n步骤1:当嵌入式设备可用的资源不能满足传统分组卷积,则采用数据合并算法,具体如下:/n设D表示传统分组之后每一组的通道数,D'表示使用数据合并方法处理之后的每一组的通道数,令Q=D/D',S=D%D',其中/代表取整,%代表取余;则D=D'×Q+S=S×(Q+1)+(D'-S)×Q,即有S组数据是将每Q+1个通道进行合并,其余的D'-S组数据是将每Q个通道进行合并;/n步骤2:当嵌入式设备可用的资源除了满足传统分组卷积还有剩余,则采用数据选择算法,具体如下:/n设Total表示整个输入数据的通道数,D表示传统分组之后每一组的通道数,D'表示使用数据选择方法处理之后的每组的通道数,如果Total<D',则令D'=Total,选择D'-D个通道作为重复计算的部分;否则对于每一组,依次向下选取D'-D个通道作为重复计算的部分,如果向下没有足够可用的通道数,则向上取D'-D个通道作为重复计算的部分。/n
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