[发明专利]一种基于FPGA的中断延时计数系统及方法有效
| 申请号： | 201910887180.2 | 申请日： | 2019-09-19 |
| 公开（公告）号： | CN110765045B | 公开（公告）日： | 2021-08-03 |
| 发明（设计）人： | 王峰 | 申请（专利权）人： | 苏州浪潮智能科技有限公司 |
| 主分类号： | G06F13/24 | 分类号： | G06F13/24;G06F13/42 |
| 代理公司： | 济南舜源专利事务所有限公司 37205 | 代理人： | 刘雪萍 |
| 地址： | 215100 江苏省苏州市吴*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明提出的一种基于FPGA的中断延时计数系统及方法，从外设中断触发，一直到主机处理完中断服务程序，中断延时计数器能准确计算出主机处理中断的时长。计算的结果也不需要通过主机告知对应中断模块，中断模块直接就可以从该延时计数器获得对应的时长。 | ||
| 搜索关键词： | 一种 基于 fpga 中断 延时 计数 系统 方法 | ||
【主权项】：
1.一种基于FPGA的中断延时计数系统，包括主机和多个外设，所述外设分别向主机发送中断请求信号，其特征在于，还包括中断延时计数器，所述中断延时计数器分别与主机和外设连接；/n所述中断延时计数器包括：配置模块、控制模块和计数模块，所述配置模块和控制模块分别与计数模块连接，配置模块、控制模块和计数模块分别与主机连接，计数模块与外设连接；/n所述配置模块用于接收主机的配置信息，所述配置信息包括时钟频率和外设的中断类型；/n所述控制模块用于控制计数模块的计数动作；/n所述计数模块根据配置模块的配置信息和控制模块的控制信息，对每个外设的中断请求进行计数，并根据计数值计算得出主机处理中断服务程序的时间。/n
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