[发明专利]只读存储器查表细分电路中的加减信号发生器逻辑设计方法在审
| 申请号： | 201910953681.6 | 申请日： | 2019-10-09 |
| 公开（公告）号： | CN110764732A | 公开（公告）日： | 2020-02-07 |
| 发明（设计）人： | 李炎冰;鲁海玥 | 申请（专利权）人： | 中国航空工业集团公司洛阳电光设备研究所 |
| 主分类号： | G06F7/575 | 分类号： | G06F7/575;H03K19/20 |
| 代理公司： | 61204 西北工业大学专利中心 | 代理人： | 刘新琼 |
| 地址： | 471099 *** | 国省代码： | 河南;41 |
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| 摘要： | 本发明涉及一种只读存储器查表细分电路中的加减信号发生器逻辑设计方法，引入了只读存储器的高两位输出D7和D6的前状态D7′和D6′，通过分析D7和D6、D7′和D6′、加信号UP以及减信号DOWN，得到了辨向逻辑真值表。由真值表推导出辨向的逻辑表达式，通过设计一个简单电路即可实现辨向功能，具有原理简单，可靠性高的特点。 | ||
| 搜索关键词： | 只读存储器 真值表 逻辑设计 加减信号发生器 逻辑表达式 简单电路 细分电路 位输出 推导 查表 引入 分析 | ||
【主权项】：
1.一种只读存储器查表细分电路中的加减信号发生器逻辑设计方法，其特征在于包括两个D触发器、一个与门和一个非门，由逻辑控制器提供4MHz时钟输入，只读存储器的高两位输出D7和D6分别作为一个D触发器的输入，经一个D触发器输出为D7′、
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