[发明专利]无除法器的除三电路有效
| 申请号： | 201911120525.8 | 申请日： | 2019-11-15 |
| 公开（公告）号： | CN110851110B | 公开（公告）日： | 2022-04-01 |
| 发明（设计）人： | 陈会军;张喆;李德建;马岩;沈红伟;郝先人;唐晓柯;刘浩 | 申请（专利权）人： | 北京智芯微电子科技有限公司;国网信息通信产业集团有限公司;国家电网有限公司 |
| 主分类号： | G06F7/535 | 分类号： | G06F7/535 |
| 代理公司： | 北京兴智翔达知识产权代理有限公司 11768 | 代理人： | 张玉梅 |
| 地址： | 100192 北京市海淀区*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明公开了一种无除法器的除三电路，电路中的Esum加法器用于对二进制数据中位于偶数位的各个二进制数进行相加从而得到加数Esum。Osum加法器用于对二进制数据中位于奇数位的各个二进制数进行相加从而得到加数Osum。第一多路选择器用于比较加数Esum和加数Osum，若加数Esum大于等于加数Osum，则计算加数Esum和加数Osum的差，并将加数Esum和加数Osum的差进行输出，若加数Esum小于加数Osum，则计算加数Osum和加数Esum的差，并将该差值左移1位，从而得到加数Osum和加数Esum的差的两倍，并将其进行输出。该无除法器的除三电路能够节约硬件资源、降低功耗以及成本。 | ||
| 搜索关键词： | 法器 电路 | ||
【主权项】：
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