[实用新型]一种半导体双NMOS芯片有效
申请号: | 201920077866.0 | 申请日: | 2019-01-17 |
公开(公告)号: | CN209374449U | 公开(公告)日: | 2019-09-10 |
发明(设计)人: | 翟晓君;宋永奇 | 申请(专利权)人: | 上海神沃电子有限公司 |
主分类号: | H01L27/02 | 分类号: | H01L27/02;H01L27/088 |
代理公司: | 上海光华专利事务所(普通合伙) 31219 | 代理人: | 余明伟 |
地址: | 201108 *** | 国省代码: | 上海;31 |
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摘要: | 本实用新型提供一种半导体双NMOS芯片,包括:半导体IC芯片本体的上表面包括依次相连的第一侧边、第二侧边、第三侧边、第四侧边;源极钝化层;IC芯片预留区位于半导体双NMOS芯片本体上表面中心区;第一源极焊盘窗口位于第四侧边的边缘区域;第二源极焊盘窗口位于第三侧边的边缘区域;漏极焊盘窗口横跨于中心线上且位于第二侧边与IC芯片预留区之间;其他栅极焊盘窗口和源极焊盘窗口位于第一侧边与IC芯片预留区之间;所述各窗口设置于源极钝化层中;所述各窗口内填充有金属层。本实用新型的半导体双NMOS芯片有利于器件体积缩小、内阻减小,减少封装成本,打线缩短,减少线损,具有便于封装连接,提高控制灵敏度,提高工作稳定性和抗干扰能力的作用。 | ||
搜索关键词: | 侧边 半导体 源极焊盘 预留区 本实用新型 边缘区域 钝化层 芯片 源极 封装 半导体IC芯片 工作稳定性 抗干扰能力 上表面中心 漏极焊盘 体积缩小 芯片本体 依次相连 栅极焊盘 金属层 灵敏度 上表面 打线 减小 内阻 线损 填充 横跨 | ||
【主权项】:
1.一种半导体双NMOS芯片,其特征在于,包括:半导体双NMOS芯片本体,所述半导体双NMOS芯片本体包括第一NMOS和第二NMOS,所述半导体双NMOS芯片本体的上表面包括依次相连的第一侧边、第二侧边、第三侧边、第四侧边,所述半导体双NMOS芯片本体具有中心线,所述中心线穿过所述第一侧边和所述第二侧边的中部;源极钝化层,所述源极钝化层包括第一源极钝化层和第二源极钝化层,所述第一源极钝化层设置于所述第一NMOS的上表面,所述第二源极钝化层设置于所述第二NMOS的上表面;IC芯片预留区,位于所述半导体双NMOS芯片本体上表面中心区;第一源极焊盘窗口,设置于所述第一源极钝化层中,所述第一源极焊盘窗口位于所述第四侧边的边缘区域,所述第一源极焊盘窗口内填充有金属层;第二源极焊盘窗口,设置于所述第二源极钝化层中,所述第二源极焊盘窗口位于所述第三侧边的边缘区域,所述第二源极焊盘窗口内填充有金属层;漏极焊盘窗口,设置于所述第一源极钝化层和所述第二源极钝化层中,所述漏极焊盘窗口横跨于所述中心线上,所述漏极焊盘窗口位于所述第二侧边与所述IC芯片预留区之间,所述漏极焊盘窗口内填充有金属层;第一栅极焊盘窗口,设置于所述第一源极钝化层中,所述第一栅极焊盘窗口位于所述第一侧边与所述IC芯片预留区之间,所述第一栅极焊盘窗口位于所述中心线的边缘区域,所述第一栅极焊盘窗口内填充有金属层;第二栅极焊盘窗口,设置于所述第二源极钝化层中,所述第二栅极焊盘窗口位于所述第一侧边与所述IC芯片预留区之间,所述第二栅极焊盘窗口位于所述中心线的边缘区域,所述第二栅极焊盘窗口内填充有金属层;第三源极焊盘窗口,设置于所述第一源极钝化层中,所述第三源极焊盘窗口位于所述第一侧边与所述IC芯片预留区之间,所述第三源极焊盘窗口内填充有金属层;第四源极焊盘窗口,设置于所述第二源极钝化层中,所述第四源极焊盘窗口位于所述第一侧边与所述IC芯片预留区之间,所述第四源极焊盘窗口内填充有金属层。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
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H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
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