[发明专利]集成电路的数据处理引擎拼片架构在审
| 申请号： | 201980024465.1 | 申请日： | 2019-03-22 |
| 公开（公告）号： | CN111954872A | 公开（公告）日： | 2020-11-17 |
| 发明（设计）人： | G·H·K·比尔斯基;J·J·诺古拉·塞拉;B·奥兹古尔;J·兰格;D·克拉克;S·B·达特 | 申请（专利权）人： | 赛灵思公司 |
| 主分类号： | G06F13/16 | 分类号： | G06F13/16;G06F15/80;G06F13/40;G06F15/163 |
| 代理公司： | 北京市金杜律师事务所 11256 | 代理人： | 傅远 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种用于集成电路(IC)中的数据处理引擎(DPE)阵列(105)的示例DPE(110)，包括核(202)；存储器(204)，其包括数据存储器(208)和程序存储器(206)，该程序存储器耦合到核，该数据存储器耦合到核并且包括与DPE外部的相应至少一个附加核(202)的至少一个连接(316)；支持电路系统，其包括各自耦合到数据存储器的硬件同步电路系统(218)和直接存储器访问(DMA)电路系统(220)；流互连(210)，其连接到DMA电路系统和核；以及存储器映射互连(212)，其耦合到核、存储器和支持电路系统。 | ||
| 搜索关键词： | 集成电路 数据处理 引擎 架构 | ||
【主权项】：
暂无信息
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