[发明专利]用于完成级联的时钟环状总线的系统和方法有效
申请号: | 201980029460.8 | 申请日: | 2019-03-29 |
公开(公告)号: | CN112055945B | 公开(公告)日: | 2023-10-27 |
发明(设计)人: | W·李 | 申请(专利权)人: | 德吉润股份有限公司 |
主分类号: | H04J3/06 | 分类号: | H04J3/06;H04L12/42;G06F5/08;G06F1/08;G06F1/10;G06F5/06 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 黄嵩泉;张鑫 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | 一种级联时钟环状网络包括时钟路径,该时钟路径通过从第一处理节点到最后处理节点的串联连接的处理节点传输源时钟。数据路径响应于所传输的源时钟,通过从第一处理节点到最后处理节点的处理节点传输数据。最后处理节点提供所传输的源时钟作为结束时钟信号,并提供所传输的数据作为结束数据值。响应于结束时钟信号结束数据值被写入FIFO存储器。随后使用源时钟信号从FIFO存储器读取结束数据值,并将其提供给第一处理节点。同步电路确保在从FIFO存储器读取结束数据值之前最初将多个结束数据值写入FIFO存储器。 | ||
搜索关键词: | 用于 完成 级联 时钟 环状 总线 系统 方法 | ||
【主权项】:
暂无信息
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