[发明专利]一种基于DDR读数据的分数时钟周期同步系统及方法有效
| 申请号： | 202010098636.X | 申请日： | 2020-02-18 |
| 公开（公告）号： | CN111338426B | 公开（公告）日： | 2021-06-25 |
| 发明（设计）人： | 王亮;朱敏 | 申请（专利权）人： | 芯创智（北京）微电子有限公司 |
| 主分类号： | G06F1/12 | 分类号： | G06F1/12;G11C7/22;H03L7/091 |
| 代理公司： | 北京天悦专利代理事务所(普通合伙) 11311 | 代理人： | 田明;杨方 |
| 地址： | 100176 北京市大兴区北京经济*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明公开了一种基于DDR读数据的分数时钟周期同步系统及方法，系统包括：采样寄存器、数字锁相环和数字延迟级数控制电路；数字锁相环用于根据自身的延迟级数对采样信号进行延迟，得到延迟信号；采样寄存器用于经过延迟信号采样数据选通信号，并将采样结果发送至数字延迟级数控制电路；数字延迟级数控制电路用于根据接收的采样结果控制数字锁相环的延迟级数。本发明实现采样信号DQS_gate和数据选通信号DQS的同步，生成无毛刺DQS信号，改善了设计上的时序问题。 | ||
| 搜索关键词： | 一种 基于 ddr 读数 分数 时钟 周期 同步 系统 方法 | ||
【主权项】：
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