[发明专利]一种生成解析verilog电路网表编译器的系统及方法在审
| 申请号： | 202010148192.6 | 申请日： | 2020-03-05 |
| 公开（公告）号： | CN111400984A | 公开（公告）日： | 2020-07-10 |
| 发明（设计）人： | 李海军;涂开辉 | 申请（专利权）人： | 中科亿海微电子科技（苏州）有限公司 |
| 主分类号： | G06F30/343 | 分类号： | G06F30/343;G06F8/30;G06F8/41 |
| 代理公司： | 北京市中闻律师事务所 11388 | 代理人： | 冯梦洪 |
| 地址： | 215000 江苏省苏州市苏州工业园区金*** | 国省代码： | 江苏;32 |
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| 摘要： | 一种生成解析verilog电路网表编译器的系统及方法，其可以大大减少编写编译器的工作量，同时可以有针对性地优化解析过程，提高解析效率，生成过程简单，工作量小，逻辑结构清晰，可扩展性强，便于后续布局布线等工作的开展。系统包括：Lex翻译器、Yacc编译器、C编译器；Lex翻译器，其配置来将Lex源程序解析为用C编写的词法分析器文件；Yacc编译器，其配置来将文法说明文件解析为用C编写的语法分析器文件；C编译器，其配置来将用C编写的词法分析器文件和用C编写的语法分析器文件生成解析verilog文法编译器。 | ||
| 搜索关键词： | 一种 生成 解析 verilog 路网 编译器 系统 方法 | ||
【主权项】：
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