[发明专利]基于信号名哈希匹配的Verilog模块接口信号自动连接方法及系统有效
| 申请号： | 202010440900.3 | 申请日： | 2020-05-22 |
| 公开（公告）号： | CN111666730B | 公开（公告）日： | 2022-10-28 |
| 发明（设计）人： | 曾坤;周宏伟;杨乾明;张英;冯权友;励楠;张见;赵振宇 | 申请（专利权）人： | 中国人民解放军国防科技大学 |
| 主分类号： | G06F30/32 | 分类号： | G06F30/32;G06F16/22 |
| 代理公司： | 湖南兆弘专利事务所(普通合伙) 43008 | 代理人： | 谭武艺 |
| 地址： | 410073 湖南*** | 国省代码： | 湖南;43 |
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| 摘要： |
本发明公开了一种基于信号名哈希匹配的Verilog模块接口信号自动连接方法及系统，本发明方法首先通过扫描Verilog模块的信号名称，构建各个模块输出信号的哈希表，然后利用哈希表的高速查找技术，对各个模块的接口信号名称按照三种规则进行匹配；最后依据各个模块接口的匹配结果自动连接各个模块的接口信号。本发明能够以很低的复杂度完成大规模Verilog硬件设计的模块接口信号自动连接，大大降低硬件设计师的工作负担，设所有待连接的Verlog模块的接口信号总数为 |
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| 搜索关键词： | 基于 信号 名哈希 匹配 verilog 模块 接口 自动 连接 方法 系统 | ||
【主权项】：
暂无信息
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