[发明专利]一种DSP处理器与FPGA周期性通信的防帧错方法在审
| 申请号： | 202011219913.4 | 申请日： | 2020-11-05 |
| 公开（公告）号： | CN114443560A | 公开（公告）日： | 2022-05-06 |
| 发明（设计）人： | 王茂义;王洋 | 申请（专利权）人： | 北京华航无线电测量研究所 |
| 主分类号： | G06F15/78 | 分类号： | G06F15/78 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 100013 *** | 国省代码： | 北京;11 |
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| 摘要： | 本发明公开一种DSP处理器与FPGA周期性通信的防帧错方法，在DSP+FPGA系统中的指令状态通信中，通常DSP按照某一周期给FPGA发送数据帧，而FPGA则是按照另一周期或者非周期，向下一级转发指令状态数据。即使协议上规定DSP和FPGA的周期相同，但是实际上，两个芯片的周期也不是绝对的相同，存在些微差别。经过差别累计，若FPGA接收到指令状态数据后，不采取保护措施，直接转发至下一级，容易产生数据帧错乱的现象。为了解决此问题，本发明在FPGA内通过2级缓存FIFO+RAM的方式，实现数据完整帧的保护，确保FPGA转发的数据是完整的数据帧，不会出现拼帧现象。 | ||
| 搜索关键词： | 一种 dsp 处理器 fpga 周期性 通信 防帧错 方法 | ||
【主权项】：
暂无信息
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