[发明专利]可重构处理单元阵列的寄存器堆设计方法及装置在审
| 申请号： | 202011506065.5 | 申请日： | 2020-12-18 |
| 公开（公告）号： | CN112486904A | 公开（公告）日： | 2021-03-12 |
| 发明（设计）人： | 尹首一;蒋昱;谷江源;钟鸣;罗列;张淞;韩慧明;刘雷波;魏少军 | 申请（专利权）人： | 清华大学 |
| 主分类号： | G06F15/78 | 分类号： | G06F15/78 |
| 代理公司： | 北京三友知识产权代理有限公司 11127 | 代理人： | 薛平;侯天印 |
| 地址： | 10008*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明公开了一种可重构处理单元阵列的寄存器堆设计方法及装置，其中，该方法包括：采用数据局部和全局共享结合、数据和配置信息分离存储的方式，对每个可重构处理单元阵列PEA的全局寄存器堆GR进行设计，其中，每个PEA包括：多个处理器单元PE；采用数据和配置信息分离存储的方式，对每个PE的局部寄存器堆LR进行设计。本发明通过层次化的寄存器文件设计，能够充分利用可重构处理器单元阵列中各个处理单元的资源，提升可重构处理器单元阵列的系统性能。 | ||
| 搜索关键词： | 可重构 处理 单元 阵列 寄存器 设计 方法 装置 | ||
【主权项】：
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