[发明专利]一种RISC-V指令集余数指令的实现方法及系统在审
| 申请号： | 202110062056.X | 申请日： | 2021-01-18 |
| 公开（公告）号： | CN112905236A | 公开（公告）日： | 2021-06-04 |
| 发明（设计）人： | 刘权胜;余红斌;刘磊 | 申请（专利权）人： | 广东赛昉科技有限公司 |
| 主分类号： | G06F9/302 | 分类号： | G06F9/302;G06F9/30 |
| 代理公司： | 上海邦德专利代理事务所(普通合伙) 31312 | 代理人： | 史文军 |
| 地址： | 528300 广东省佛山市顺德*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明涉及微处理器技术领域，具体涉及一种RISC‑V指令集余数指令的实现方法及系统，本发明对CPU乱序执行，指令从取指单元进入指令译码单元，进行指令译码；译码完成后的指令在重命名单元进行目的寄存器的重命名，同时对余数指令进行优化；若余数指令不满足优化条件时，重命名之后的指令进入保留站后，进入执行单元执行；执行完成后的指令通过重排序缓存提交，并释放在重命名阶段分配的除法指令编码缓存资源。本发明在重命名阶段通过增加余数指令加速单元实现余数指令的功能，当除法和余数指令配对出现时，通过余数指令的目的寄存器映射到除法指令写余数的物理寄存器，取到除法指令产生的余数，余数指令执行效率高。 | ||
| 搜索关键词： | 一种 risc 指令 余数 实现 方法 系统 | ||
【主权项】：
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