[发明专利]基于Verilog实现的微处理器自动化验证方法及验证装置在审
| 申请号： | 202110550463.5 | 申请日： | 2021-05-20 |
| 公开（公告）号： | CN113283211A | 公开（公告）日： | 2021-08-20 |
| 发明（设计）人： | 邱景;叶菲;周华 | 申请（专利权）人： | 复旦大学 |
| 主分类号： | G06F30/398 | 分类号： | G06F30/398;G06F11/36 |
| 代理公司： | 上海盈盛知识产权代理事务所(普通合伙) 31294 | 代理人： | 孙佳胤;陈丽丽 |
| 地址： | 200433 *** | 国省代码： | 上海;31 |
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| 摘要： | 本发明涉及通信技术领域，尤其涉及一种基于Verilog实现的微处理器自动化验证方法及验证装置。所述基于Verilog实现的微处理器自动化验证方法包括如下步骤：建立映射对应关系，所述映射对应关系包括多个调用模块、与多个调用模块一一对应的多个测试激励模块，所述测试激励模块用于产生测试激励；调用微处理器中的待测电路当前验证所需的目标调用模块；根据所述映射对应关系选择与所述目标调用模块对应的目标测试激励模块；加载所述目标测试激励模块产生的目标测试激励至所述待测电路，以对所述待测电路进行验证。本发明简化了微处理器的验证过程，减少了测试人员的工作量，缩短了微处理器的设计周期。 | ||
| 搜索关键词： | 基于 verilog 实现 微处理器 自动化 验证 方法 装置 | ||
【主权项】：
暂无信息
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